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    "schema_version": "via_ai_product_manager_jobs_v1",
    "data_type": "ai_product_manager_jobs",
    "job": {
        "job_title": "ASIC设计工程师-AI芯片",
        "job_level": "未披露",AI生成
        "work_category": "全职",AI生成
        "department": "未披露",
        "location": "北京",
        "work_mode": "未披露",AI生成
        "job_category": "硬件"AI生成
    },
    "company": {
        "company_name": "字节跳动",
        "company_industry": "互联网 / 数字内容 / 电商",
        "company_size": "10000人以上",
        "company_website": "bytedance.com",
        "company_description": "字节跳动提供内容创作、信息分发、电商和协作产品，旗下产品包括抖音、今日头条、TikTok和飞书。"
    },
    "compensation": {
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            "currency": "未披露",
            "cycle": "未披露"
        },
        "benefits": "未披露"
    },
    "requirements": {
        "working_years": 3,
        "degree": "微电子、计算机等相关专业本科及以上学历",
        "language": "未披露",AI生成
        "visa_support": "未披露",
        "responsibilities": "1、负责数据中心内ASIC芯片的微架构设计、RTL设计和集成；\n2、支持AI加速芯片的Power/Performance/Area优化和设计流程优化；\n3、支持AI加速芯片的验证和其他开发。",
        "requirements_text": "1、微电子、计算机等相关专业本科及以上学历，3年及以上IC设计经验；\n2、对芯片前端设计有深入理解，有坚实的RTL设计基础，精通Verilog等硬件设计语言；\n3、有主动学习、深入分析和解决问题的能力、自我驱动力。\n\n加分项：\n1、熟悉ASIC芯片的前端设计，有过16nm或更先进工艺流片或量产经验；\n2、深入理解芯片架构和微架构设计，能够设计出满足PPA要求的RTL实现；\n3、有CPU/NoC/高性能计算的设计经验；\n4、了解DDR/PCIE等协议，有相关的IP集成经验；\n5、熟悉ASIC实现流程，有综合/FV/CLP/STA等经验；\n6、了解主流的AI算法，如：视觉、NLP处理、语音等。",
        "skills": [AI生成
            "Verilog",
            "架构设计",
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    "contact": {
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        "contact_methods": [
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    "posting": {
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        "job_url": "https://jobs.bytedance.com/experienced/position/6925710783553980685/detail"
    },
    "fulltext": "ASIC设计工程师-AI芯片\n职位描述\n1、负责数据中心内ASIC芯片的微架构设计、RTL设计和集成；\n2、支持AI加速芯片的Power/Performance/Area优化和设计流程优化；\n3、支持AI加速芯片的验证和其他开发。\n\n职位要求\n1、微电子、计算机等相关专业本科及以上学历，3年及以上IC设计经验；\n2、对芯片前端设计有深入理解，有坚实的RTL设计基础，精通Verilog等硬件设计语言；\n3、有主动学习、深入分析和解决问题的能力、自我驱动力。\n\n加分项：\n1、熟悉ASIC芯片的前端设计，有过16nm或更先进工艺流片或量产经验；\n2、深入理解芯片架构和微架构设计，能够设计出满足PPA要求的RTL实现；\n3、有CPU/NoC/高性能计算的设计经验；\n4、了解DDR/PCIE等协议，有相关的IP集成经验；\n5、熟悉ASIC实现流程，有综合/FV/CLP/STA等经验；\n6、了解主流的AI算法，如：视觉、NLP处理、语音等。\n1、负责数据中心内ASIC芯片的微架构设计、RTL设计和集成；\n2、支持AI加速芯片的Power/Performance/Area优化和设计流程优化；\n3、支持AI加速芯片的验证和其他开发。\n1、微电子、计算机等相关专业本科及以上学历，3年及以上IC设计经验；\n2、对芯片前端设计有深入理解，有坚实的RTL设计基础，精通Verilog等硬件设计语言；\n3、有主动学习、深入分析和解决问题的能力、自我驱动力。\n\n加分项：\n1、熟悉ASIC芯片的前端设计，有过16nm或更先进工艺流片或量产经验；\n2、深入理解芯片架构和微架构设计，能够设计出满足PPA要求的RTL实现；\n3、有CPU/NoC/高性能计算的设计经验；\n4、了解DDR/PCIE等协议，有相关的IP集成经验；\n5、熟悉ASIC实现流程，有综合/FV/CLP/STA等经验；\n6、了解主流的AI算法，如：视觉、NLP处理、语音等。"
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