主分类：芯片设计与验证
来源 JD 数据（旧分类保留，当前主分类见上方）
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"schema_version": "via_ai_product_manager_jobs_v1",
"data_type": "ai_product_manager_jobs",
"job": {
"job_title": "芯片设计工程师(北京/上海/深圳)",
"job_level": "未披露",AI生成
"work_category": "全职",AI生成
"department": "TEG",
"location": "北京",
"work_mode": "未披露",AI生成
"job_category": "技术"AI生成
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"company": {
"company_name": "腾讯",
"company_industry": "互联网 / 科技 / 人工智能",
"company_size": "10000人以上",
"company_website": "tencent.com",
"company_description": "腾讯是一家互联网和科技公司，业务覆盖通信与社交、数字内容、游戏、金融科技、企业服务、云计算与人工智能等方向。"
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"compensation": {
"salary_range": {
"min": "",
"max": "",
"currency": "未披露",
"cycle": "未披露"
},
"benefits": "未披露"
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"requirements": {
"working_years": 3,
"degree": "微电子、集成电路、电子工程、计算机、通信专业硕士及以上学历",
"language": "未披露",AI生成
"visa_support": "未披露",
"responsibilities": "1.参与SoC/IP 系统/子系统的设计和实现；\r\n2.负责模块架构设计、RTL实现、时序分析优化以及模块的PPA优化；\r\n3.支撑 SoC/IP 的系统集成，以及文档编写；\r\n4.与性能分析团队一起进行芯片性能改进；\r\n5.与设计验证团队一起制定验证测试计划，覆盖率分析，芯片仿真以及调试。",
"requirements_text": "1.微电子、集成电路、电子工程、计算机、通信专业硕士及以上学历；\r\n2.熟悉数字电路设计原理和集成电路设计流程，了解ASIC/FPGA设计流程，包括逻辑综合、布局布线、时序分析和验证等；\r\n3.良好的编程能力，熟练掌握至少一种硬件描述语言（如Verilog或VHDL）,熟悉C/C++、Python或其他编程语言；\r\n4.熟悉EDA工具（如Cadence、Synopsys或Mentor Graphics等）的使用；\r\n5.熟悉数字电路设计技术，如处理器架构、存储器、总线接口等。",
"skills": [AI生成
"Python",
"C++",
"Verilog",
"FPGA",
"电路设计",
"数字电路"
],
"preferred_qualifications": "未披露",
"job_highlights": "未披露"
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"contact": {
"recruiter_name": "未披露",
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"type": "apply_link",
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"posting": {
"posting_id": "2070518634735906816",
"post_date": "2026-07-10",
"hire_time": "未披露",
"update_date": "20260917",
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"fulltext": "芯片设计工程师(北京/上海/深圳)\n1.参与SoC/IP 系统/子系统的设计和实现；\r\n2.负责模块架构设计、RTL实现、时序分析优化以及模块的PPA优化；\r\n3.支撑 SoC/IP 的系统集成，以及文档编写；\r\n4.与性能分析团队一起进行芯片性能改进；\r\n5.与设计验证团队一起制定验证测试计划，覆盖率分析，芯片仿真以及调试。\n1.微电子、集成电路、电子工程、计算机、通信专业硕士及以上学历；\r\n2.熟悉数字电路设计原理和集成电路设计流程，了解ASIC/FPGA设计流程，包括逻辑综合、布局布线、时序分析和验证等；\r\n3.良好的编程能力，熟练掌握至少一种硬件描述语言（如Verilog或VHDL）,熟悉C/C++、Python或其他编程语言；\r\n4.熟悉EDA工具（如Cadence、Synopsys或Mentor Graphics等）的使用；\r\n5.熟悉数字电路设计技术，如处理器架构、存储器、总线接口等。",
"standard_classification": {
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