主分类：芯片设计与验证
来源 JD 数据（旧分类保留，当前主分类见上方）
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"data_type": "ai_product_manager_jobs",
"job": {
"job_title": "达摩院-SOC原型验证专家-RISC V及生态",
"job_level": "专家",AI生成
"work_category": "全职",AI生成
"department": "阿里集团",
"location": "杭州 / 上海",
"work_mode": "未披露",AI生成
"job_category": "技术-芯片"AI生成
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"company": {
"company_name": "阿里巴巴控股集团",
"company_industry": "电子商务 / 云计算 / 人工智能",
"company_size": "未披露",
"company_website": "alibaba.com",
"company_description": "阿里巴巴集团面向消费者和企业提供电子商务、云计算及人工智能服务。"
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"compensation": {
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"degree": "通信或计算机本科及以上学历",
"language": "未披露",AI生成
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"responsibilities": "1. 负责在Emulator上对产品进行验证；\n2. 负责制定子系统以及SOC级硅前验证计划，例如Core，Mesh一致性总线，PCIE, DDR等，并在EMU上完成验证规划；\n3. 重点承担在Core/总线/PCIE的系统大压力测试、场景验证以及性能验证，与EDA验证形成互补；\n4. 与EDA验证团队合作，移植部分EDA用例，加大压力测试；\n5. 负责建立SOC原型验证流程，并持续改进计划，以提高测试效率、工具性能，保证验证质量；\n6.协同设计/验证/软件工程师，共同完成debug工作；",
"requirements_text": "1. 电子，通信或计算机本科及以上学历；\n2. 精通芯片验证语言、流程以及验证方法学，如SystemVerilog, UVM等；精通C/C++等面向对象语言;\n3. 精通Synopsys Zebu或Cadence Palladium或Siemens Veloce等至少一种使用经验，搭建过emulator平台，熟悉常用的工具，掌握相应的调试方法；\n4. 精通其中一个或多个领域：RISCV core，CHI Mesh 总线，PCIE，DDR，跨DIE，跨Chip等，精通CPU芯片微架构，并有能力通过波形进行debug；\n5. 具备一定的软件开发能力，能搭建bare metal验证环境，并开发自动化测试用例；\n6. 具有良好的团队合作和创业精神，能独立思考和解决问题，有责任心和上进心；",
"skills": [AI生成
"C++",
"SystemVerilog",
"自动化测试",
"芯片验证",
"团队协作",
"解决问题"
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"fulltext": "达摩院-SOC原型验证专家-RISC V及生态\n达摩院-SOC原型验证专家-RISC V及生态\n\n基础信息\n职位类别：技术-芯片\n工作地点：杭州 / 上海\n\n职位描述\n1. 负责在Emulator上对产品进行验证；\n2. 负责制定子系统以及SOC级硅前验证计划，例如Core，Mesh一致性总线，PCIE, DDR等，并在EMU上完成验证规划；\n3. 重点承担在Core/总线/PCIE的系统大压力测试、场景验证以及性能验证，与EDA验证形成互补；\n4. 与EDA验证团队合作，移植部分EDA用例，加大压力测试；\n5. 负责建立SOC原型验证流程，并持续改进计划，以提高测试效率、工具性能，保证验证质量；\n6.协同设计/验证/软件工程师，共同完成debug工作；\n\n职位要求\n1. 电子，通信或计算机本科及以上学历；\n2. 精通芯片验证语言、流程以及验证方法学，如SystemVerilog, UVM等；精通C/C++等面向对象语言;\n3. 精通Synopsys Zebu或Cadence Palladium或Siemens Veloce等至少一种使用经验，搭建过emulator平台，熟悉常用的工具，掌握相应的调试方法；\n4. 精通其中一个或多个领域：RISCV core，CHI Mesh 总线，PCIE，DDR，跨DIE，跨Chip等，精通CPU芯片微架构，并有能力通过波形进行debug；\n5. 具备一定的软件开发能力，能搭建bare metal验证环境，并开发自动化测试用例；\n6. 具有良好的团队合作和创业精神，能独立思考和解决问题，有责任心和上进心；\n1. 负责在Emulator上对产品进行验证；\n2. 负责制定子系统以及SOC级硅前验证计划，例如Core，Mesh一致性总线，PCIE, DDR等，并在EMU上完成验证规划；\n3. 重点承担在Core/总线/PCIE的系统大压力测试、场景验证以及性能验证，与EDA验证形成互补；\n4. 与EDA验证团队合作，移植部分EDA用例，加大压力测试；\n5. 负责建立SOC原型验证流程，并持续改进计划，以提高测试效率、工具性能，保证验证质量；\n6.协同设计/验证/软件工程师，共同完成debug工作；\n1. 电子，通信或计算机本科及以上学历；\n2. 精通芯片验证语言、流程以及验证方法学，如SystemVerilog, UVM等；精通C/C++等面向对象语言;\n3. 精通Synopsys Zebu或Cadence Palladium或Siemens Veloce等至少一种使用经验，搭建过emulator平台，熟悉常用的工具，掌握相应的调试方法；\n4. 精通其中一个或多个领域：RISCV core，CHI Mesh 总线，PCIE，DDR，跨DIE，跨Chip等，精通CPU芯片微架构，并有能力通过波形进行debug；\n5. 具备一定的软件开发能力，能搭建bare metal验证环境，并开发自动化测试用例；\n6. 具有良好的团队合作和创业精神，能独立思考和解决问题，有责任心和上进心；",
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"std_taxonomy_version": "20261104"
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