主分类:芯片设计与验证
来源 JD 数据(旧分类保留,当前主分类见上方)
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"job": {
"job_title": "达摩院-高级指令集架构师-RISC V及生态",
"job_level": "高级",AI生成
"work_category": "全职",AI生成
"department": "阿里集团",
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"job_category": "技术-芯片"AI生成
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"company": {
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"company_description": "阿里巴巴集团面向消费者和企业提供电子商务、云计算及人工智能服务。"
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"degree": "教育与经验:微电子、计算机工程、计算机科学或相关专业**硕士及以上**学历",
"language": "6. 英文能力:读写熟练;能够在英文技术会议中清晰表达技术观点、参与讨论",AI生成
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"responsibilities": "参与玄铁高性能处理器的指令集与编程模型定义和演进,作为市场/产品需求与微架构、软件生态之间的技术枢纽;负责玄铁指令集与编程模型管理平台的建设,并代表玄铁参与RISC-V国际基金会相关规范标准工作。\n1. 负责玄铁指令集扩展定义。接收市场、产品与研发的功能与性能诉求,与微架构、编译器、内核、计算库等团队协同,参与制定指令和寄存器编码、语义、异常行为等编程模型,输出正式规范文档并推动内部评审、落地与迭代。\n2. 负责玄铁编程模型管理平台建设。保证指令集变更以结构化、机器可读的方式沉淀到平台,驱动下游RTL生成、工具链集成、验证套件构建、规范文档生成与模拟器/参考模型的自动化更新。\n3. 代表玄铁参与国际基金会相关规范标准工作。跟进上游标准与相关工作组的演进,把玄铁的技术需求提案化并推动被上游接纳;把上游产出高质量地回流到玄铁内部平台,保持双向对齐。\n4. RISC-V生态跟踪与前瞻研究。持续跟踪RISC-V在向量、矩阵、虚拟化、安全、性能监测、机密计算等方向的新扩展动态;结合玄铁产品路线,主动提出新扩展的预研提案。",
"requirements_text": "1. 教育与经验:微电子、计算机工程、计算机科学或相关专业**硕士及以上**学历;具备**5年以上**处理器架构、指令集、编译器或操作系统内核领域的相关经验。\n2. 汇编与指令集精通:能读写至少一门主流汇编(**RISC-V优先**,ARM或x86亦可),能够从汇编视角审视指令语义、编码效率与编程模型的合理性。\n3.熟悉软件栈:熟悉操作系统内核、工具链、性能建模、计算库/AI编译器等软件栈中的至少一类,两类及以上者优先。\n4. 处理器微架构基础:了解乱序执行、存储系统、异常与中断、虚拟化、向量计算等微架构机制,能够评估指令扩展的实现代价。\n5. 跨团队沟通与推动力:能够在软件、硬件、产品与标准组织的跨团队场景中协调冲突、达成技术共识、推动决策落地。\n6. 英文能力:读写熟练;能够在英文技术会议中清晰表达技术观点、参与讨论。\n加分项\n- 有RISC-V或定制化指令集扩展的定义或提案经验;\n- 有编写指令集规范或处理器用户手册的经验;\n- 具备高性能CPU微架构相关经验,参与过乱序执行、分支预测、存储系统、向量/矩阵执行单元、性能建模(gem5等)方向的开发或项目工作;\n- 有ISA仿真器或参考模型的开发或深度使用经验,例如Spike、QEMU、Sail,或自研参考模型;\n- 熟悉业界主流的机器可读ISA规范,参与过任一类似平台的schema设计、扩展条目维护、下游生成器(编码表、汇编器、反汇编器、模拟器、文档)开发者优先;\n- 有RISC-V国际基金会或其他开源组织、社区的贡献经验;\n- 具备C/C++、Python或Ruby编程能力,能编写工具脚本、编码生成器或参考模型代码。",
"skills": [AI生成
"Python",
"C++",
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"preferred_qualifications": "2. 汇编与指令集精通:能读写至少一门主流汇编(**RISC-V优先**,ARM或x86亦可),能够从汇编视角审视指令语义、编码效率与编程模型的合理性;3.熟悉软件栈:熟悉操作系统内核、工具链、性能建模、计算库/AI编译器等软件栈中的至少一类,两类及以上者优先;加分项;熟悉业界主流的机器可读ISA规范,参与过任一类似平台的schema设计、扩展条目维护、下游生成器(编码表、汇编器、反汇编器、模拟器、文档)开发者优先",
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"fulltext": "达摩院-高级指令集架构师-RISC V及生态\n达摩院-高级指令集架构师-RISC V及生态\n\n基础信息\n职位类别:技术-芯片\n工作地点:北京 / 杭州 / 上海\n\n职位描述\n参与玄铁高性能处理器的指令集与编程模型定义和演进,作为市场/产品需求与微架构、软件生态之间的技术枢纽;负责玄铁指令集与编程模型管理平台的建设,并代表玄铁参与RISC-V国际基金会相关规范标准工作。\n1. 负责玄铁指令集扩展定义。接收市场、产品与研发的功能与性能诉求,与微架构、编译器、内核、计算库等团队协同,参与制定指令和寄存器编码、语义、异常行为等编程模型,输出正式规范文档并推动内部评审、落地与迭代。\n2. 负责玄铁编程模型管理平台建设。保证指令集变更以结构化、机器可读的方式沉淀到平台,驱动下游RTL生成、工具链集成、验证套件构建、规范文档生成与模拟器/参考模型的自动化更新。\n3. 代表玄铁参与国际基金会相关规范标准工作。跟进上游标准与相关工作组的演进,把玄铁的技术需求提案化并推动被上游接纳;把上游产出高质量地回流到玄铁内部平台,保持双向对齐。\n4. RISC-V生态跟踪与前瞻研究。持续跟踪RISC-V在向量、矩阵、虚拟化、安全、性能监测、机密计算等方向的新扩展动态;结合玄铁产品路线,主动提出新扩展的预研提案。\n\n职位要求\n1. 教育与经验:微电子、计算机工程、计算机科学或相关专业**硕士及以上**学历;具备**5年以上**处理器架构、指令集、编译器或操作系统内核领域的相关经验。\n2. 汇编与指令集精通:能读写至少一门主流汇编(**RISC-V优先**,ARM或x86亦可),能够从汇编视角审视指令语义、编码效率与编程模型的合理性。\n3.熟悉软件栈:熟悉操作系统内核、工具链、性能建模、计算库/AI编译器等软件栈中的至少一类,两类及以上者优先。\n4. 处理器微架构基础:了解乱序执行、存储系统、异常与中断、虚拟化、向量计算等微架构机制,能够评估指令扩展的实现代价。\n5. 跨团队沟通与推动力:能够在软件、硬件、产品与标准组织的跨团队场景中协调冲突、达成技术共识、推动决策落地。\n6. 英文能力:读写熟练;能够在英文技术会议中清晰表达技术观点、参与讨论。\n加分项\n- 有RISC-V或定制化指令集扩展的定义或提案经验;\n- 有编写指令集规范或处理器用户手册的经验;\n- 具备高性能CPU微架构相关经验,参与过乱序执行、分支预测、存储系统、向量/矩阵执行单元、性能建模(gem5等)方向的开发或项目工作;\n- 有ISA仿真器或参考模型的开发或深度使用经验,例如Spike、QEMU、Sail,或自研参考模型;\n- 熟悉业界主流的机器可读ISA规范,参与过任一类似平台的schema设计、扩展条目维护、下游生成器(编码表、汇编器、反汇编器、模拟器、文档)开发者优先;\n- 有RISC-V国际基金会或其他开源组织、社区的贡献经验;\n- 具备C/C++、Python或Ruby编程能力,能编写工具脚本、编码生成器或参考模型代码。\n参与玄铁高性能处理器的指令集与编程模型定义和演进,作为市场/产品需求与微架构、软件生态之间的技术枢纽;负责玄铁指令集与编程模型管理平台的建设,并代表玄铁参与RISC-V国际基金会相关规范标准工作。\n1. 负责玄铁指令集扩展定义。接收市场、产品与研发的功能与性能诉求,与微架构、编译器、内核、计算库等团队协同,参与制定指令和寄存器编码、语义、异常行为等编程模型,输出正式规范文档并推动内部评审、落地与迭代。\n2. 负责玄铁编程模型管理平台建设。保证指令集变更以结构化、机器可读的方式沉淀到平台,驱动下游RTL生成、工具链集成、验证套件构建、规范文档生成与模拟器/参考模型的自动化更新。\n3. 代表玄铁参与国际基金会相关规范标准工作。跟进上游标准与相关工作组的演进,把玄铁的技术需求提案化并推动被上游接纳;把上游产出高质量地回流到玄铁内部平台,保持双向对齐。\n4. RISC-V生态跟踪与前瞻研究。持续跟踪RISC-V在向量、矩阵、虚拟化、安全、性能监测、机密计算等方向的新扩展动态;结合玄铁产品路线,主动提出新扩展的预研提案。\n1. 教育与经验:微电子、计算机工程、计算机科学或相关专业**硕士及以上**学历;具备**5年以上**处理器架构、指令集、编译器或操作系统内核领域的相关经验。\n2. 汇编与指令集精通:能读写至少一门主流汇编(**RISC-V优先**,ARM或x86亦可),能够从汇编视角审视指令语义、编码效率与编程模型的合理性。\n3.熟悉软件栈:熟悉操作系统内核、工具链、性能建模、计算库/AI编译器等软件栈中的至少一类,两类及以上者优先。\n4. 处理器微架构基础:了解乱序执行、存储系统、异常与中断、虚拟化、向量计算等微架构机制,能够评估指令扩展的实现代价。\n5. 跨团队沟通与推动力:能够在软件、硬件、产品与标准组织的跨团队场景中协调冲突、达成技术共识、推动决策落地。\n6. 英文能力:读写熟练;能够在英文技术会议中清晰表达技术观点、参与讨论。\n加分项\n- 有RISC-V或定制化指令集扩展的定义或提案经验;\n- 有编写指令集规范或处理器用户手册的经验;\n- 具备高性能CPU微架构相关经验,参与过乱序执行、分支预测、存储系统、向量/矩阵执行单元、性能建模(gem5等)方向的开发或项目工作;\n- 有ISA仿真器或参考模型的开发或深度使用经验,例如Spike、QEMU、Sail,或自研参考模型;\n- 熟悉业界主流的机器可读ISA规范,参与过任一类似平台的schema设计、扩展条目维护、下游生成器(编码表、汇编器、反汇编器、模拟器、文档)开发者优先;\n- 有RISC-V国际基金会或其他开源组织、社区的贡献经验;\n- 具备C/C++、Python或Ruby编程能力,能编写工具脚本、编码生成器或参考模型代码。",
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