主分类：芯片设计与验证
来源 JD 数据（旧分类保留，当前主分类见上方）
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"job": {
"job_title": "达摩院-高性能RISC-V CPU架构和集成专家/高级专家-计算技术",
"job_level": "专家",AI生成
"work_category": "全职",AI生成
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"job_category": "技术-芯片"AI生成
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"company": {
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"company_industry": "电子商务 / 云计算 / 人工智能",
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"company_description": "阿里巴巴集团面向消费者和企业提供电子商务、云计算及人工智能服务。"
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"responsibilities": "该职位负责高性能RISC-V CPU子系统外围模块的集成和测试点分解。具体职责包括：\n1. 根据服务器CPU 调试场景，定义RISC-V Debug/Trace 特性和架构，并完成RTL集成和测试点分解\n2. 根据服务器CPU中断处理的软/硬件场景，定义RISC-V AIA模块的特性和架构，并完成RTL集成和测试点分解\n3. 根据服务器CPU内存管理的软/硬件场景，定义RISC-V IOMMU特性和架构，并完成RTL集成和测试点分解",
"requirements_text": "为支持上述职能，我们期望的候选人具备如下技能和背景：\n软件开发背景：\n1. 精通C语言\n2. 了解Linux kernel，特别是Linux kernel中中断/内存管理模块\n3. 有kernel开发背景是加分项\n体系架构能力:\n1. 熟悉RISC-V 指令集和体系结构。\n2. 熟悉RISC-V标准中的debug、AIA、IOMMU中的至少一项，或者有X86/ARM架构下debug/中断/内存管理的设计/集成背景。\n3. 熟悉AXI/AHB/APB协议。\n4. 有Spec编写背景，能将Spec转化成芯片验证/测试点。\n逻辑设计能力:\n1. 精通Verilog/SystemVerilog ，有大规模SoC子系统集成背景。\n2. 优秀的RTL问题定位能力。\n3. 熟悉后端设计流程，具备编写时序约束和进行静态时序分析能力。",
"skills": [AI生成
"Linux",
"Verilog",
"SystemVerilog",
"芯片验证",
"分析能力",
"C语言"
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"preferred_qualifications": "3. 有kernel开发背景是加分项",
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"fulltext": "达摩院-高性能RISC-V CPU架构和集成专家/高级专家-计算技术\n达摩院-高性能RISC-V CPU架构和集成专家/高级专家-计算技术\n\n基础信息\n职位类别：技术-芯片\n工作地点：成都 / 北京 / 上海\n\n职位描述\n该职位负责高性能RISC-V CPU子系统外围模块的集成和测试点分解。具体职责包括：\n1. 根据服务器CPU 调试场景，定义RISC-V Debug/Trace 特性和架构，并完成RTL集成和测试点分解\n2. 根据服务器CPU中断处理的软/硬件场景，定义RISC-V AIA模块的特性和架构，并完成RTL集成和测试点分解\n3. 根据服务器CPU内存管理的软/硬件场景，定义RISC-V IOMMU特性和架构，并完成RTL集成和测试点分解\n\n职位要求\n为支持上述职能，我们期望的候选人具备如下技能和背景：\n软件开发背景：\n1. 精通C语言\n2. 了解Linux kernel，特别是Linux kernel中中断/内存管理模块\n3. 有kernel开发背景是加分项\n体系架构能力:\n1. 熟悉RISC-V 指令集和体系结构。\n2. 熟悉RISC-V标准中的debug、AIA、IOMMU中的至少一项，或者有X86/ARM架构下debug/中断/内存管理的设计/集成背景。\n3. 熟悉AXI/AHB/APB协议。\n4. 有Spec编写背景，能将Spec转化成芯片验证/测试点。\n逻辑设计能力:\n1. 精通Verilog/SystemVerilog ，有大规模SoC子系统集成背景。\n2. 优秀的RTL问题定位能力。\n3. 熟悉后端设计流程，具备编写时序约束和进行静态时序分析能力。\n该职位负责高性能RISC-V CPU子系统外围模块的集成和测试点分解。具体职责包括：\n1. 根据服务器CPU 调试场景，定义RISC-V Debug/Trace 特性和架构，并完成RTL集成和测试点分解\n2. 根据服务器CPU中断处理的软/硬件场景，定义RISC-V AIA模块的特性和架构，并完成RTL集成和测试点分解\n3. 根据服务器CPU内存管理的软/硬件场景，定义RISC-V IOMMU特性和架构，并完成RTL集成和测试点分解\n为支持上述职能，我们期望的候选人具备如下技能和背景：\n软件开发背景：\n1. 精通C语言\n2. 了解Linux kernel，特别是Linux kernel中中断/内存管理模块\n3. 有kernel开发背景是加分项\n体系架构能力:\n1. 熟悉RISC-V 指令集和体系结构。\n2. 熟悉RISC-V标准中的debug、AIA、IOMMU中的至少一项，或者有X86/ARM架构下debug/中断/内存管理的设计/集成背景。\n3. 熟悉AXI/AHB/APB协议。\n4. 有Spec编写背景，能将Spec转化成芯片验证/测试点。\n逻辑设计能力:\n1. 精通Verilog/SystemVerilog ，有大规模SoC子系统集成背景。\n2. 优秀的RTL问题定位能力。\n3. 熟悉后端设计流程，具备编写时序约束和进行静态时序分析能力。",
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