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职位列表 链接有效 不适用(官网全量采集) official:alibaba:199907620038

芯片设计/验证/DFT工程师

未披露 · 北京 / 成都 / 上海 / 深圳 · 平头哥

主分类:芯片设计与验证
硬件、电子与电气研发
来源 JD 数据(旧分类保留,当前主分类见上方)
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        "company_description": "平头哥研发计算、存储及网络芯片,为人工智能基础设施提供支持。"
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        "visa_support": "未披露",
        "responsibilities": "1. 使用Verilog & System Verilog编写芯片RTL代码; \n2. 搭建测试平台,产生测试向量验证芯片Function和Performance; \n3. 使用综合工具产生网表,优化时序/面积,并参与分析后端布局布线的结果;\n4. 使用Power分析工具优化芯片功耗; \n5. 开发自动化流程提高芯片设计效率。",
        "requirements_text": "1. 熟悉ASIC芯片设计流程;\n2. 熟悉System Verilog, Verilog等设计语言;\n3. 熟悉Simulation, Synthesis, Lint, Formal Verification等流程和EDA工具的使用;\n4. 熟悉Linux/Unix系统环境,精通Python, Ruby, Perl, TCL, C/C++, Makefile等至少一门编程语言;\n5. 学习能力强,能快速适应新环境;良好的沟通能力和团队协同能力。\n【加分项】\n1. 熟悉ASIC芯片验证方法学,熟悉UVM/OVM;\n2. 熟悉计算机体系结构,了解深度学习算法;\n3. 有相关实习及项目经历。",
        "skills": [AI生成
            "Python",
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            "Verilog",
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    "fulltext": "芯片设计/验证/DFT工程师\n芯片设计/验证/DFT工程师\n\n基础信息\n毕业起止时间要求:2026-11-01 - 2027-10-31\n职位类别:技术类\n招聘项目:阿里巴巴2027届应届生\n工作地点:北京 / 成都 / 上海 / 深圳\n\n职位描述\n1. 使用Verilog & System Verilog编写芯片RTL代码; \n2. 搭建测试平台,产生测试向量验证芯片Function和Performance; \n3. 使用综合工具产生网表,优化时序/面积,并参与分析后端布局布线的结果;\n4. 使用Power分析工具优化芯片功耗; \n5. 开发自动化流程提高芯片设计效率。\n\n职位要求\n1. 熟悉ASIC芯片设计流程;\n2. 熟悉System Verilog, Verilog等设计语言;\n3. 熟悉Simulation, Synthesis, Lint, Formal Verification等流程和EDA工具的使用;\n4. 熟悉Linux/Unix系统环境,精通Python, Ruby, Perl, TCL, C/C++, Makefile等至少一门编程语言;\n5. 学习能力强,能快速适应新环境;良好的沟通能力和团队协同能力。\n【加分项】\n1. 熟悉ASIC芯片验证方法学,熟悉UVM/OVM;\n2. 熟悉计算机体系结构,了解深度学习算法;\n3. 有相关实习及项目经历。\n\n在招业务\n平头哥\n1. 使用Verilog & System Verilog编写芯片RTL代码; \n2. 搭建测试平台,产生测试向量验证芯片Function和Performance; \n3. 使用综合工具产生网表,优化时序/面积,并参与分析后端布局布线的结果;\n4. 使用Power分析工具优化芯片功耗; \n5. 开发自动化流程提高芯片设计效率。\n1. 熟悉ASIC芯片设计流程;\n2. 熟悉System Verilog, Verilog等设计语言;\n3. 熟悉Simulation, Synthesis, Lint, Formal Verification等流程和EDA工具的使用;\n4. 熟悉Linux/Unix系统环境,精通Python, Ruby, Perl, TCL, C/C++, Makefile等至少一门编程语言;\n5. 学习能力强,能快速适应新环境;良好的沟通能力和团队协同能力。\n【加分项】\n1. 熟悉ASIC芯片验证方法学,熟悉UVM/OVM;\n2. 熟悉计算机体系结构,了解深度学习算法;\n3. 有相关实习及项目经历。",
    "standard_classification": {
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