主分类：芯片设计与验证
来源 JD 数据（旧分类保留，当前主分类见上方）
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"data_type": "ai_product_manager_jobs",
"job": {
"job_title": "处理器架构师-指令侧",
"job_level": "未披露",AI生成
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"location": "西安、北京、深圳",
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"job_category": "软件研发"AI生成
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"company": {
"company_name": "小米集团",
"company_industry": "消费电子 / 智能制造 / 物联网",
"company_size": "10000人以上",
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"company_description": "小米是一家消费电子和智能制造企业，以智能手机、智能硬件和物联网平台为核心。"
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"degree": "硕士及以上学历",
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"responsibilities": "1. 参与或主导Vector/Matrix单元微架构和算子设计，进行性能、功耗论证，并完成RTL实现与调优；\n2. 在高性能计算/内存系统/能效优化/安全架构至少一个方向有深度研究和技术输出；\n3. 与芯片设计、编译器、软件团队协同，确保处理器架构方案的可实现性和性能目标达成；\n4. 跟踪业界处理器架构前沿技术（如AI芯片加速指令集、端侧大模型部署架构），输出技术洞察，牵引架构演进方向；\n5. 参与芯片流片和回片验证，确保架构方案的工程落地；",
"requirements_text": "1. 硕士及以上学历，计算机/电子工程/微电子等相关专业；\n2. 精通计算机体系结构核心理论(流水线/缓存/多核一致性)；\n3. 熟悉RISC-V/ARM/x86微架构设计，熟练使用Verilog/Chisel；\n4. 掌握Gem5/VCS等工具链，在高性能计算/内存系统/能效优化/安全架构至少一个方向有深度研究；\n5. 有RTL设计或芯片流片经验者优先；\n6. 具备AI芯片加速指令集设计经验、大模型部署架构理解或跨领域（芯片+AI/编译器）协作经验者优先。",
"skills": [AI生成
"Verilog",
"架构设计",
"大语言模型"
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"preferred_qualifications": "5. 有RTL设计或芯片流片经验者优先；6. 具备AI芯片加速指令集设计经验、大模型部署架构理解或跨领域（芯片+AI/编译器）协作经验者优先",
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"fulltext": "处理器架构师-指令侧\n职位描述\n1. 参与或主导Vector/Matrix单元微架构和算子设计，进行性能、功耗论证，并完成RTL实现与调优；\n2. 在高性能计算/内存系统/能效优化/安全架构至少一个方向有深度研究和技术输出；\n3. 与芯片设计、编译器、软件团队协同，确保处理器架构方案的可实现性和性能目标达成；\n4. 跟踪业界处理器架构前沿技术（如AI芯片加速指令集、端侧大模型部署架构），输出技术洞察，牵引架构演进方向；\n5. 参与芯片流片和回片验证，确保架构方案的工程落地；\n\n职位要求\n1. 硕士及以上学历，计算机/电子工程/微电子等相关专业；\n2. 精通计算机体系结构核心理论(流水线/缓存/多核一致性)；\n3. 熟悉RISC-V/ARM/x86微架构设计，熟练使用Verilog/Chisel；\n4. 掌握Gem5/VCS等工具链，在高性能计算/内存系统/能效优化/安全架构至少一个方向有深度研究；\n5. 有RTL设计或芯片流片经验者优先；\n6. 具备AI芯片加速指令集设计经验、大模型部署架构理解或跨领域（芯片+AI/编译器）协作经验者优先。\n1. 参与或主导Vector/Matrix单元微架构和算子设计，进行性能、功耗论证，并完成RTL实现与调优；\n2. 在高性能计算/内存系统/能效优化/安全架构至少一个方向有深度研究和技术输出；\n3. 与芯片设计、编译器、软件团队协同，确保处理器架构方案的可实现性和性能目标达成；\n4. 跟踪业界处理器架构前沿技术（如AI芯片加速指令集、端侧大模型部署架构），输出技术洞察，牵引架构演进方向；\n5. 参与芯片流片和回片验证，确保架构方案的工程落地；\n1. 硕士及以上学历，计算机/电子工程/微电子等相关专业；\n2. 精通计算机体系结构核心理论(流水线/缓存/多核一致性)；\n3. 熟悉RISC-V/ARM/x86微架构设计，熟练使用Verilog/Chisel；\n4. 掌握Gem5/VCS等工具链，在高性能计算/内存系统/能效优化/安全架构至少一个方向有深度研究；\n5. 有RTL设计或芯片流片经验者优先；\n6. 具备AI芯片加速指令集设计经验、大模型部署架构理解或跨领域（芯片+AI/编译器）协作经验者优先。",
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