主分类：芯片设计与验证
来源 JD 数据（旧分类保留，当前主分类见上方）
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"data_type": "ai_product_manager_jobs",
"job": {
"job_title": "处理器芯片工程师（AI方向）",
"job_level": "未披露",AI生成
"work_category": "全职",AI生成
"department": "未披露",
"location": "北京、西安、深圳",
"work_mode": "未披露",AI生成
"job_category": "硬件研发"AI生成
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"company": {
"company_name": "小米集团",
"company_industry": "消费电子 / 智能制造 / 物联网",
"company_size": "10000人以上",
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"company_description": "小米是一家消费电子和智能制造企业，以智能手机、智能硬件和物联网平台为核心。"
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"compensation": {
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"benefits": "未披露"
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"requirements": {
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"degree": "本科及以上学历",
"language": "未披露",AI生成
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"responsibilities": "1. 参与或主导AI处理器核心微架构设计，完成RTL实现与调优，覆盖推理和训练两个场景；\n2. 在AI计算单元（矩阵/向量）、存储子系统、数据流架构、片上互联等方向至少一项有深度研究和技术输出；\n3. 与处理器架构、编译器、软件团队协同，确保AI处理器微架构方案的可实现性和性能目标达成；\n4. 跟踪业界AI处理器架构前沿技术（如存内计算、稀疏计算、混合精度训练），输出技术洞察，牵引微架构演进方向；\n5. 参与芯片流片和回片验证，确保AI处理器微架构方案的工程落地；",
"requirements_text": "1. 本科及以上学历，计算机/电子工程/微电子等相关专业；\n2. 精通计算机体系结构核心理论，熟悉AI计算模式（矩阵乘、卷积、Attention等）；\n3. 熟悉RISC-V/ARM处理器微架构设计，熟练使用Verilog/SystemVerilog；\n4. 掌握Gem5/VCS等工具链，在AI计算单元/存储子系统/数据流架构/片上互联至少一个方向有深度研究；\n5. 有RTL设计或芯片流片经验者优先；\n6. 有AI加速器/NPU芯片设计经验、大模型部署架构理解或跨领域（芯片+AI框架/编译器）协作经验者优先。",
"skills": [AI生成
"Verilog",
"SystemVerilog",
"架构设计",
"芯片设计",
"大语言模型"
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"preferred_qualifications": "5. 有RTL设计或芯片流片经验者优先；6. 有AI加速器/NPU芯片设计经验、大模型部署架构理解或跨领域（芯片+AI框架/编译器）协作经验者优先",
"job_highlights": "未披露"
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"fulltext": "处理器芯片工程师（AI方向）\n职位描述\n1. 参与或主导AI处理器核心微架构设计，完成RTL实现与调优，覆盖推理和训练两个场景；\n2. 在AI计算单元（矩阵/向量）、存储子系统、数据流架构、片上互联等方向至少一项有深度研究和技术输出；\n3. 与处理器架构、编译器、软件团队协同，确保AI处理器微架构方案的可实现性和性能目标达成；\n4. 跟踪业界AI处理器架构前沿技术（如存内计算、稀疏计算、混合精度训练），输出技术洞察，牵引微架构演进方向；\n5. 参与芯片流片和回片验证，确保AI处理器微架构方案的工程落地；\n\n职位要求\n1. 本科及以上学历，计算机/电子工程/微电子等相关专业；\n2. 精通计算机体系结构核心理论，熟悉AI计算模式（矩阵乘、卷积、Attention等）；\n3. 熟悉RISC-V/ARM处理器微架构设计，熟练使用Verilog/SystemVerilog；\n4. 掌握Gem5/VCS等工具链，在AI计算单元/存储子系统/数据流架构/片上互联至少一个方向有深度研究；\n5. 有RTL设计或芯片流片经验者优先；\n6. 有AI加速器/NPU芯片设计经验、大模型部署架构理解或跨领域（芯片+AI框架/编译器）协作经验者优先。\n1. 参与或主导AI处理器核心微架构设计，完成RTL实现与调优，覆盖推理和训练两个场景；\n2. 在AI计算单元（矩阵/向量）、存储子系统、数据流架构、片上互联等方向至少一项有深度研究和技术输出；\n3. 与处理器架构、编译器、软件团队协同，确保AI处理器微架构方案的可实现性和性能目标达成；\n4. 跟踪业界AI处理器架构前沿技术（如存内计算、稀疏计算、混合精度训练），输出技术洞察，牵引微架构演进方向；\n5. 参与芯片流片和回片验证，确保AI处理器微架构方案的工程落地；\n1. 本科及以上学历，计算机/电子工程/微电子等相关专业；\n2. 精通计算机体系结构核心理论，熟悉AI计算模式（矩阵乘、卷积、Attention等）；\n3. 熟悉RISC-V/ARM处理器微架构设计，熟练使用Verilog/SystemVerilog；\n4. 掌握Gem5/VCS等工具链，在AI计算单元/存储子系统/数据流架构/片上互联至少一个方向有深度研究；\n5. 有RTL设计或芯片流片经验者优先；\n6. 有AI加速器/NPU芯片设计经验、大模型部署架构理解或跨领域（芯片+AI框架/编译器）协作经验者优先。",
"standard_classification": {
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