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产研周远泽 2026-07-05T16:00:00.000Z FPGA工程师-深圳 2 全职普通 2026-07-30T16:00:00.000Z 关于朗伯威LAMBERV 高端视觉传感器供应商 | 国家级高新技术企业 | 清华团队 | 高速成长期企业朗伯威中国官网：www.lamberv.com 任职要求： 1、统招本科以上学历，3年以上图像处理/信号处理算法FPGA开发经验； 2、熟练的掌握掌握Verilog语言； 3、有高速信号调试经验，熟悉MIPI，PCIE，USB等接口；熟悉LVDS； 4、具有大规模电路逻辑设计经验和调试经验，能够解决复杂的时序问题； 5、具备数量阅读英文文档的能力； 6、能接受研发攻关期加班和一定的工作压力。岗位职责： 1、负责超高分辨率智能工业相机、计算成像传感产品的图像、视觉算法的硬件逻辑实现方案论证； 2、负责FPGA逻辑的设计、开发、调试以及维护等工作； 3、配合软件、硬件工程师进行产品设计开发过程中的软硬件联调和验证； 4、负责FPGA相关文档的撰写和整理。公司福利 1、办公室咖啡、小零食每日无限量供应； 2、核心团队来自清华大学，公司业务高速健康增长，产品研发采用前沿技术路线，提供有竞争力的职业晋升机会。 3、团队扁平化管理，成员年轻化，只要敢拼敢干，空间不设限；图像。LVDS 22-30K HC2026070605 67adaef1fe156cbf02573142 00050 [{'name': '周远泽', 'username': 'c945b5g9', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'c945b5g9'}, {'name': '唐汇沙', 'username': 'adb78383', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'adb78383'}] [{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [29], 'integrate_id': 'e3378688'}] [{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [29], 'integrate_id': 'e3378688'}] [{'name': '户孝围', 'username': '3eabb56d', 'status': 1, 'type': 0, 'departments': [22, 4], 'integrate_id': '3eabb56d'}] 社招深圳-源政创业大厦 3-5年大小周(早9晚9) 通过 2026-07-05T16:00:00.000Z 已启动 2026-07-05T16:00:00.000Z 125 42 25 9 4 1 7 1 2 未完成 0.5 FPGA 研发 80.79038462

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        "overall_match": "候选人具备5年扎实的FPGA开发经验，在高速信号处理、复杂时序分析及逻辑设计方面能力突出，与岗位核心技术要求高度匹配，整体推荐录用。",
        "key_strengths": [
            "具备5年FPGA开发经验，远超JD要求的3年门槛",
            "拥有丰富的高速信号（LVDS）及复杂时序（DDR3\/EMIF）调试与逻辑设计经验",
            "熟练掌握UVM验证方法学，能有力支持岗位要求的软硬件联调与验证工作"
        ],
        "key_concerns": [
            "缺乏直接的图像处理或视觉算法FPGA实现经验，需核实算法硬件化能力",
            "未明确表态是否接受大小周及高强度加班节奏",
            "期望薪资、当前所在城市及到岗时间等关键信息缺失"
        ],
        "recommendation_summary": "候选人技术底子深厚，高速信号与逻辑设计能力完全胜任岗位需求，稳定性良好。虽缺乏直接的视觉算法FPGA经验且部分节奏信息缺失，但不影响其作为高潜力技术人选的强烈推荐。"
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            "jd_requirement": "3年以上图像处理\/信号处理算法FPGA经验；熟练Verilog；高速信号调试（MIPI\/PCIE\/USB\/LVDS）；大规模逻辑设计与复杂时序问题解决；英文文档阅读。",
            "resume_fulfillment": "具备5年FPGA开发经验；精通Verilog及大规模逻辑设计，有DDR3\/EMIF复杂时序分析经验；具备LVDS高速串行接收设计经验；英语四级满足英文阅读要求；额外具备深厚的UVM验证经验。但缺乏直接的图像\/视觉算法FPGA实现经验。"
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            "jd_requirement": "未明确说明，默认评估历史任职时长与稳定性模式。",
            "resume_fulfillment": "最近一段正式工作（南航电子 FPGA工程师）任职长达5年（2021.3-2026.3），远超24个月的稳定标准，表现出极高的职业稳定性。当前空档期约6个月，在合理范围内。"
        },
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            "jd_requirement": "深圳-源政创业大厦；大小周(早9晚9)；研发攻关期加班和一定工作压力。",
            "resume_fulfillment": "推断候选人当前在深圳（前两段工作均在深圳），地点匹配。但未明确说明是否接受大小周、早9晚9及高强度加班，也未提供到岗时间，关键节奏意愿信息缺失。"
        },
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            "jd_requirement": "此项为简历信息表达质量评估，JD无直接要求。",
            "resume_fulfillment": "简历模块清晰，教育、技能、工作、项目经历字段完整。项目描述详实，清晰说明了技术背景、个人动作与量化结果。存在少量PDF解析带来的重复水印乱码，但不影响整体阅读。"
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        "候选人是否接受大小周（早9晚9）及研发攻关期高强度加班未知。",
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