简历初筛详情

简历初筛 #1197

记录详情

返回列表
请求 ID
1-6acefd18-15d82d-e865f9fa08ba
状态
success
创建时间
2026-10-14 11:59:21
提取时间
2026-10-14 03:57:34
ID id
1197
请求 ID request_id
1-6acefd18-15d82d-e865f9fa08ba
提取时间 extracted_at
2026-10-14 03:57:34
source_bucket source_bucket
langbowei-static
源对象 source_object
parsed/resumes/1-6acefd18-15d82d-e865f9fa08ba__widget_1704704635359_0.pdf.parsed.json
对象大小 object_size
39057
event_name event_name
ObjectCreated:PutObject
event_time event_time
2026-10-14T03:57:32.000Z
etag etag
FA71F517CB0EEB34DCB2BED06BF030AC
model model
qwen3.8-flash
文本长度 text_length
16843
jd_text jd_text
招聘岗位名称:FPGA工程师-深圳 岗位类型:全职 招聘类型:社招 工作地点:深圳-源政创业大厦 工作年限:3-5年 期望薪资范围:22-30K 适用工作安排:大小周(早9晚9) 招聘人数:2 招聘紧急程度:普通 期望到岗日期:2026-07-31 岗位JD:关于朗伯威LAMBERV 高端视觉传感器供应商 | 国家级高新技术企业 | 清华团队 | 高速成长期企业 朗伯威中国官网:www.lamberv.com 任职要求: 1、统招本科以上学历,3年以上图像处理/信号处理算法FPGA开发经验; 2、熟练的掌握掌握Verilog语言; 3、有高速信号调试经验,熟悉MIPI,PCIE,USB等接口;熟悉LVDS; 4、具有大规模电路逻辑设计经验和调试经验,能够解决复杂的时序问题; 5、具备数量阅读英文文档的能力; 6、能接受研发攻关期加班和一定的工作压力。 岗位职责: 1、负责超高分辨率智能工业相机、计算成像传感产品的图像、视觉算法的硬件逻辑实现方案论证; 2、负责FPGA逻辑的设计、开发、调试以及维护等工作; 3、配合软件、硬件工程师进行产品设计开发过程中的软硬件联调和验证; 4、负责FPGA相关文档的撰写和整理。 公司福利 1、办公室咖啡、小零食每日无限量供应; 2、核心团队来自清华大学,公司业务高速健康增长,产品研发采用前沿技术路线,提供有竞争力的职业晋升机会。 3、团队扁平化管理,成员年轻化,只要敢拼敢干,空间不设限; 筛选标准:图像。LVDS
r1_json r1_json
JSON
{
    "r1_score": 55,
    "core_skill_score": 27,
    "project_score": 12,
    "industry_transfer_sc": 12,
    "info_integrity_score": 4,
    "reason": "第一轮筛选:55\/65\n\n维度1“技术”:39\/46\n加分「+27分:FPGA图像职责」\n加分「+12分:项目负责人」\n扣分「-0分:无」\n待验证「0分:Verilog实证」\n待验证「0分:LVDS工程」\n待验证「0分:英文文档」\n待验证「0分:大规模时序」\n\n维度2“其他”:16\/19\n加分「+12分:成像场景相近」\n加分「+6分:字段基本完整」\n扣分「-2分:时间轻微冲突」\n待验证「0分:到岗时间」\n\n待验证项:\n- 核心技术:Verilog实证\n- 核心技术:LVDS工程\n- 核心技术:英文文档\n- 核心技术:大规模时序\n- 信息完整:到岗时间\n- 信息完整:期望城市\n\n冲突项:\n- 中元经历:项目时间\n- 瑞图经历:项目开始"
}
r2_json r2_json
JSON
{
    "r2_score": 20,
    "scene_score": 8,
    "seniority_score": 8,
    "company_score": 2,
    "edu_score": 2,
    "edu_school_tag": "本科(许昌学院·四年制)",
    "ind_rel_tag": "相关",
    "industry_job_tag": "高级FPGA工程师(场景差异·待验证)",
    "industry_tag": "不在关注企业名单内",
    "matched_company": "无",
    "salary_tag": "unknown",
    "reason_r2": "维度1 8\/16:非工业检测→维度2 8\/9:年限管理足→维度3 2\/7:光电相近待验证→维度4 2\/3:本科统招→待验证:岗位场景卡场景标签未填写;企业白名单未检索到匹配条目;落地场景不同:候选人场景内窥镜ISP vs 本公司工业检测;候选人期望薪资面议,岗位预算未配置,待HR核实→薪资:unknown"
}
r3_json r3_json
JSON
{
    "reason_r3": "备选。节奏匹配(上一份未明示,未表态);职业稳定性(职业稳定性人才·最近37个月);简历呈现(清晰完整);工作地点(同城);到岗时间(未说明到岗时间)。建议电话验证节奏与到岗,再邀约面试。",
    "status": "备选",
    "risk": "无",
    "highlight": "图像算法FPGA,LVDS\/MIPI\/PCIE,高速接口,同城,稳定性佳",
    "suggestion": "电话确认是否接受大小周及到岗时间,再邀约面试。"
}
extracted_json extracted_json
JSON
{
    "r1": {
        "status": "success",
        "data": {
            "r1_score": 55,
            "core_skill_score": 27,
            "project_score": 12,
            "industry_transfer_sc": 12,
            "info_integrity_score": 4,
            "reason": "第一轮筛选:55\/65\n\n维度1“技术”:39\/46\n加分「+27分:FPGA图像职责」\n加分「+12分:项目负责人」\n扣分「-0分:无」\n待验证「0分:Verilog实证」\n待验证「0分:LVDS工程」\n待验证「0分:英文文档」\n待验证「0分:大规模时序」\n\n维度2“其他”:16\/19\n加分「+12分:成像场景相近」\n加分「+6分:字段基本完整」\n扣分「-2分:时间轻微冲突」\n待验证「0分:到岗时间」\n\n待验证项:\n- 核心技术:Verilog实证\n- 核心技术:LVDS工程\n- 核心技术:英文文档\n- 核心技术:大规模时序\n- 信息完整:到岗时间\n- 信息完整:期望城市\n\n冲突项:\n- 中元经历:项目时间\n- 瑞图经历:项目开始"
        },
        "error": null
    },
    "r2": {
        "status": "success",
        "data": {
            "r2_score": 20,
            "scene_score": 8,
            "seniority_score": 8,
            "company_score": 2,
            "edu_score": 2,
            "edu_school_tag": "本科(许昌学院·四年制)",
            "ind_rel_tag": "相关",
            "industry_job_tag": "高级FPGA工程师(场景差异·待验证)",
            "industry_tag": "不在关注企业名单内",
            "matched_company": "无",
            "salary_tag": "unknown",
            "reason_r2": "维度1 8\/16:非工业检测→维度2 8\/9:年限管理足→维度3 2\/7:光电相近待验证→维度4 2\/3:本科统招→待验证:岗位场景卡场景标签未填写;企业白名单未检索到匹配条目;落地场景不同:候选人场景内窥镜ISP vs 本公司工业检测;候选人期望薪资面议,岗位预算未配置,待HR核实→薪资:unknown"
        },
        "error": null
    },
    "r3": {
        "status": "success",
        "data": {
            "reason_r3": "备选。节奏匹配(上一份未明示,未表态);职业稳定性(职业稳定性人才·最近37个月);简历呈现(清晰完整);工作地点(同城);到岗时间(未说明到岗时间)。建议电话验证节奏与到岗,再邀约面试。",
            "status": "备选",
            "risk": "无",
            "highlight": "图像算法FPGA,LVDS\/MIPI\/PCIE,高速接口,同城,稳定性佳",
            "suggestion": "电话确认是否接受大小周及到岗时间,再邀约面试。"
        },
        "error": null
    }
}
composite_score composite_score
75
recommended_action recommended_action
备选
output_key output_key
structured/parsed/resumes/1-6acefd18-15d82d-e865f9fa08ba__widget_1704704635359_0.pdf.parsed.json.screening.json
状态 status
success
error_message error_message
无数据
raw_event raw_event
JSON
{
    "events": [
        {
            "eventName": "ObjectCreated:PutObject",
            "eventSource": "acs:oss",
            "eventTime": "2026-10-14T03:57:32.000Z",
            "eventVersion": "1.0",
            "oss": {
                "bucket": {
                    "arn": "acs:oss:cn-hangzhou:1748673497100614:langbowei-static",
                    "name": "langbowei-static",
                    "ownerIdentity": "1748673497100614",
                    "virtualBucket": ""
                },
                "object": {
                    "deltaSize": 39057,
                    "eTag": "FA71F517CB0EEB34DCB2BED06BF030AC",
                    "key": "parsed\/resumes\/1-6acefd18-15d82d-e865f9fa08ba__widget_1704704635359_0.pdf.parsed.json",
                    "objectMeta": {
                        "mimeType": "application\/json"
                    },
                    "size": 39057
                },
                "ossSchemaVersion": "1.0",
                "ruleId": "2cb79d9565446405b8e3d3770c46f870fc17c5a5"
            },
            "region": "cn-hangzhou",
            "requestParameters": {
                "sourceIPAddress": "172.16.0.137"
            },
            "responseElements": {
                "requestId": "6ACEFDACBE7E393839B7F80D"
            },
            "userIdentity": {
                "principalId": "300891235492433224"
            }
        }
    ]
}
创建时间 created_at
2026-10-14 11:59:21