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简历初筛 #404

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请求 ID
1-6a688d00-15e8bf-e449e5262633
状态
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创建时间
2026-07-28 19:08:30
提取时间
2026-07-28 11:07:00
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404
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招聘岗位:FPGA工程师-深圳 招聘类型:社招 工作地点:深圳-源政创业大厦 工作年限:3-5年 适用工作安排:大小周(早9晚9) 岗位类型:全职 期望薪资范围:22-30K 招聘人数:1 招聘紧急程度:普通 期望到岗日期:2026-07-30 岗位JD: 关于朗伯威LAMBERV 高端视觉传感器供应商 | 国家级高新技术企业 | 清华团队 | 高速成长期企业 朗伯威中国官网:www.lamberv.com 任职要求: 1、统招本科以上学历,3年以上图像处理/信号处理算法FPGA开发经验; 2、熟练的掌握掌握Verilog语言; 3、有高速信号调试经验,熟悉MIPI,PCIE,USB等接口;熟悉LVDS; 4、具有大规模电路逻辑设计经验和调试经验,能够解决复杂的时序问题; 5、具备数量阅读英文文档的能力; 6、能接受研发攻关期加班和一定的工作压力。 岗位职责: 1、负责超高分辨率智能工业相机、计算成像传感产品的图像、视觉算法的硬件逻辑实现方案论证; 2、负责FPGA逻辑的设计、开发、调试以及维护等工作; 3、配合软件、硬件工程师进行产品设计开发过程中的软硬件联调和验证; 4、负责FPGA相关文档的撰写和整理。 公司福利 1、办公室咖啡、小零食每日无限量供应; 2、核心团队来自清华大学,公司业务高速健康增长,产品研发采用前沿技术路线,提供有竞争力的职业晋升机会。 3、团队扁平化管理,成员年轻化,只要敢拼敢干,空间不设限; 筛选标准: 校招简历储备,不推进 备注说明: 图像/影像方向,精通LVDS
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        "overall_match": "候选人为2026届应届毕业生,无正式工作经验,与岗位要求的3-5年社招经验严重不符,且缺乏JD核心要求的高速接口经验,整体不匹配。",
        "key_strengths": [
            "具备扎实的FPGA基础,熟练使用Verilog和Vivado,有完整的FPGA项目落地经验",
            "英语读写能力良好,通过四六级"
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        "key_concerns": [
            "缺乏3年以上工业级FPGA开发经验,仅为应届生",
            "未掌握MIPI\/PCIE\/LVDS等高速接口调试经验",
            "未明确是否接受深圳工作及大小周、早9晚9的高强度加班节奏"
        ],
        "recommendation_summary": "岗位明确为社招且筛选标准注明'校招简历储备,不推进',候选人为应届生且核心硬技能(高速接口)不满足,存在硬性约束风险,直接淘汰。"
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            "jd_requirement": "3年以上FPGA开发经验,熟练掌握Verilog,有高速信号调试经验(MIPI\/PCIE\/USB\/LVDS),具备大规模电路逻辑设计经验",
            "resume_fulfillment": "熟练掌握Verilog,有校内FPGA项目经验,但无3年工业级开发经验,且简历中未体现任何高速接口(LVDS等)调试经验,核心要求明确不满足"
        },
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            "jd_requirement": "社招岗位,期望3-5年稳定工作经验",
            "resume_fulfillment": "候选人为2026届应届生,无正式工作经历,无法评估稳定性"
        },
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            "name": "salary_match",
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            "jd_requirement": "期望薪资范围22-30K",
            "resume_fulfillment": "候选人未提供期望薪资,无法评估匹配度"
        },
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            "jd_requirement": "深圳线下办公,大小周(早9晚9),能接受研发攻关期加班",
            "resume_fulfillment": "候选人未提供当前城市、是否接受深圳工作、是否接受大小周及高强度加班,无法评估"
        },
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            "jd_requirement": "此项为简历信息表达质量评估,JD无直接要求",
            "resume_fulfillment": "简历结构清晰,模块完整,项目经历包含技术栈、工作内容和成果,时间线一致,表达质量高"
        }
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