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简历初筛 #684

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请求 ID
1-6a7d6d04-157f00-acb940d05c58
状态
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创建时间
2026-08-13 15:11:42
提取时间
2026-08-13 07:09:44
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684
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研发 周远泽 2026-07-05T16:00:00.000Z FPGA工程师-深圳 2 全职 普通 2026-07-30T16:00:00.000Z 关于朗伯威LAMBERV 高端视觉传感器供应商 | 国家级高新技术企业 | 清华团队 | 高速成长期企业 朗伯威中国官网:www.lamberv.com 任职要求: 1、统招本科以上学历,3年以上图像处理/信号处理算法FPGA开发经验; 2、熟练的掌握掌握Verilog语言; 3、有高速信号调试经验,熟悉MIPI,PCIE,USB等接口;熟悉LVDS; 4、具有大规模电路逻辑设计经验和调试经验,能够解决复杂的时序问题; 5、具备数量阅读英文文档的能力; 6、能接受研发攻关期加班和一定的工作压力。 岗位职责: 1、负责超高分辨率智能工业相机、计算成像传感产品的图像、视觉算法的硬件逻辑实现方案论证; 2、负责FPGA逻辑的设计、开发、调试以及维护等工作; 3、配合软件、硬件工程师进行产品设计开发过程中的软硬件联调和验证; 4、负责FPGA相关文档的撰写和整理。 公司福利 1、办公室咖啡、小零食每日无限量供应; 2、核心团队来自清华大学,公司业务高速健康增长,产品研发采用前沿技术路线,提供有竞争力的职业晋升机会。 3、团队扁平化管理,成员年轻化,只要敢拼敢干,空间不设限; 图像。LVDS 22-30K HC2026070605 67adaef1fe156cbf02573142 00050 [{'name': '周远泽', 'username': 'c945b5g9', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'c945b5g9'}, {'name': '唐汇沙', 'username': 'adb78383', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'adb78383'}] [{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [5], 'integrate_id': 'e3378688'}] [{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [5], 'integrate_id': 'e3378688'}] [{'name': '户孝围', 'username': '3eabb56d', 'status': 1, 'type': 0, 'departments': [1, 4], 'integrate_id': '3eabb56d'}] 社招 深圳-源政创业大厦 3-5年 大小周(早9晚9) 通过 2026-07-05T16:00:00.000Z 已启动 2026-07-05T16:00:00.000Z 83 24 13 6 2 1 6 1 1 未完成 0.5 FPGA 研发 82.3
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        "overall_match": "候选人具备超6年FPGA开发及图像\/信号处理经验,技术实力雄厚,稳定性良好,薪资期望完全匹配,但部分高速接口经验及加班意愿需进一步核实。",
        "key_strengths": [
            "FPGA开发经验丰富,超6年图像\/信号处理及NPU芯片前端设计经验,远超JD要求",
            "具备完整的芯片设计开发流程经验,有NPU流片及工业超声产品成功交付的复杂项目成果"
        ],
        "key_concerns": [
            "简历未明确体现MIPI、PCIE、USB、LVDS等高速接口调试经验及英文文档阅读能力",
            "未明确表态是否接受大小周(早9晚9)及研发攻关期的高强度加班节奏"
        ],
        "recommendation_summary": "候选人技术匹配度高,核心技能覆盖良好,稳定性佳且薪资在预算内。虽部分高速接口经验及加班意愿等信息缺失需面试核实,但不影响整体高匹配度,建议推进面试。"
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            "jd_requirement": "3年以上图像处理\/信号处理算法FPGA开发经验;熟练掌握Verilog;有高速信号调试经验,熟悉MIPI\/PCIE\/USB\/LVDS等接口;具备大规模电路逻辑设计及复杂时序解决能力;熟练阅读英文文档。",
            "resume_fulfillment": "具备约6.75年FPGA相关经验,精通Verilog及RTL实现,有NPU及超声信号处理等大规模逻辑设计与成功交付经验,高度满足核心要求。但简历未明确提及MIPI\/PCIE\/USB\/LVDS等具体高速接口经验及英文文档阅读能力,故置信度为medium。"
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            "jd_requirement": "未明确说明,默认评估历史任职时长与稳定性。",
            "resume_fulfillment": "最近一段正式工作(ASTRI)任职30个月,超过24个月,且期间职责从一代debug到二代全流程再到三代系统级优化,持续扩大,稳定性表现优秀。"
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            "jd_requirement": "薪资范围 22-30K。",
            "resume_fulfillment": "候选人期望薪资为税前月薪30K左右,正好处于JD预算上限范围内,匹配度极高。"
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            "jd_requirement": "深圳工作;大小周(早9晚9);能接受研发攻关期加班和一定的工作压力。",
            "resume_fulfillment": "候选人现居深圳且期望工作地为深圳,地点完全匹配。但未明确说明是否接受大小周、早9晚9及高强度加班,也未提供到岗时间,关键意愿信息缺失,置信度为low。"
        },
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            "jd_requirement": "此项为简历信息表达质量评估,JD无直接要求。",
            "resume_fulfillment": "简历模块清晰,时间线完整,项目描述详细且包含具体的背景、个人动作与成果(如NPU流片、超声产品交付),逻辑连贯,表达质量高。"
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