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研发周远泽 2026-07-05T16:00:00.000Z FPGA工程师-深圳 2 全职普通 2026-07-30T16:00:00.000Z 关于朗伯威LAMBERV 高端视觉传感器供应商 | 国家级高新技术企业 | 清华团队 | 高速成长期企业朗伯威中国官网：www.lamberv.com 任职要求： 1、统招本科以上学历，3年以上图像处理/信号处理算法FPGA开发经验； 2、熟练的掌握掌握Verilog语言； 3、有高速信号调试经验，熟悉MIPI，PCIE，USB等接口；熟悉LVDS； 4、具有大规模电路逻辑设计经验和调试经验，能够解决复杂的时序问题； 5、具备数量阅读英文文档的能力； 6、能接受研发攻关期加班和一定的工作压力。岗位职责： 1、负责超高分辨率智能工业相机、计算成像传感产品的图像、视觉算法的硬件逻辑实现方案论证； 2、负责FPGA逻辑的设计、开发、调试以及维护等工作； 3、配合软件、硬件工程师进行产品设计开发过程中的软硬件联调和验证； 4、负责FPGA相关文档的撰写和整理。公司福利 1、办公室咖啡、小零食每日无限量供应； 2、核心团队来自清华大学，公司业务高速健康增长，产品研发采用前沿技术路线，提供有竞争力的职业晋升机会。 3、团队扁平化管理，成员年轻化，只要敢拼敢干，空间不设限；图像。LVDS 22-30K HC2026070605 67adaef1fe156cbf02573142 00050 [{'name': '周远泽', 'username': 'c945b5g9', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'c945b5g9'}, {'name': '唐汇沙', 'username': 'adb78383', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'adb78383'}] [{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [5], 'integrate_id': 'e3378688'}] [{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [5], 'integrate_id': 'e3378688'}] [{'name': '户孝围', 'username': '3eabb56d', 'status': 1, 'type': 0, 'departments': [1, 4], 'integrate_id': '3eabb56d'}] 社招深圳-源政创业大厦 3-5年大小周(早9晚9) 通过 2026-07-05T16:00:00.000Z 已启动 2026-07-05T16:00:00.000Z 84 24 13 6 2 1 6 1 1 未完成 0.5 FPGA 研发 82.57272727

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    "summary": {
        "overall_match": "候选人技术能力高度匹配岗位需求，具备丰富的FPGA图像处理及高速接口项目经验，但正式工作年限略低于JD要求，且最近一段工作任职时间较短，稳定性存在一定风险。",
        "key_strengths": [
            "核心技术完全覆盖，精通Verilog及FPGA开发，有多个图像处理及高速接口相关项目落地经验",
            "简历呈现质量高，项目经历描述详实，技术栈与成果展示清晰完整"
        ],
        "key_concerns": [
            "最近一段正式工作任职仅9个月，历史平均任职2年，稳定性存在较高风险",
            "正式工作年限为2年9个月，略低于JD要求的3年以上经验"
        ],
        "recommendation_summary": "候选人技术匹配度极高，综合分74.1，但受限于稳定性风险及经验年限部分满足，推荐为pending，建议重点核实其近期频繁跳槽原因及加班意愿。"
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        },
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            "evidence": "技能列表明确包含MIPI、LVDS，项目中有相关应用，PCIE\/USB未明确提及但整体接口经验丰富"
        },
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            "evidence": "简历未明确提及英文能力，但具备工科本科背景及阅读芯片手册经验"
        },
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            "requirement": "接受研发攻关期加班和一定的工作压力",
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            "resume_fulfillment": "具备2年9个月FPGA开发经验，精通Verilog，有多个图像处理及高速接口项目经验，技术高度匹配"
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            "jd_requirement": "未明确说明，按通用稳定性标准评估",
            "resume_fulfillment": "最近一段工作任职仅9个月，前一段工作2年，历史均值2年，稳定性存在较高风险"
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