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#768
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1-6a8675fb-15f061-6d5db2edeea4
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2026-08-20 11:39:31
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产研
周远泽
2026-07-05T16:00:00.000Z
FPGA工程师-深圳
2
全职
普通
2026-07-30T16:00:00.000Z
关于朗伯威LAMBERV
高端视觉传感器供应商 | 国家级高新技术企业 | 清华团队 | 高速成长期企业 朗伯威中国官网:www.lamberv.com
任职要求:
1、统招本科以上学历,3年以上图像处理/信号处理算法FPGA开发经验;
2、熟练的掌握掌握Verilog语言;
3、有高速信号调试经验,熟悉MIPI,PCIE,USB等接口;熟悉LVDS;
4、具有大规模电路逻辑设计经验和调试经验,能够解决复杂的时序问题;
5、具备数量阅读英文文档的能力;
6、能接受研发攻关期加班和一定的工作压力。
岗位职责:
1、负责超高分辨率智能工业相机、计算成像传感产品的图像、视觉算法的硬件逻辑实现方案论证;
2、负责FPGA逻辑的设计、开发、调试以及维护等工作;
3、配合软件、硬件工程师进行产品设计开发过程中的软硬件联调和验证;
4、负责FPGA相关文档的撰写和整理。
公司福利
1、办公室咖啡、小零食每日无限量供应;
2、核心团队来自清华大学,公司业务高速健康增长,产品研发采用前沿技术路线,提供有竞争力的职业晋升机会。
3、团队扁平化管理,成员年轻化,只要敢拼敢干,空间不设限;
图像。LVDS
22-30K
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00050
[{'name': '周远泽', 'username': 'c945b5g9', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'c945b5g9'}, {'name': '唐汇沙', 'username': 'adb78383', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'adb78383'}]
[{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [29], 'integrate_id': 'e3378688'}]
[{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [29], 'integrate_id': 'e3378688'}]
[{'name': '户孝围', 'username': '3eabb56d', 'status': 1, 'type': 0, 'departments': [22, 4], 'integrate_id': '3eabb56d'}]
社招
深圳-源政创业大厦
3-5年
大小周(早9晚9)
通过
2026-07-05T16:00:00.000Z
已启动
2026-07-05T16:00:00.000Z
93
27
13
6
2
1
6
1
1
未完成
0.5
FPGA
研发
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"summary": {
"overall_match": "候选人具备16年研发经验,其中包含4.5年高度相关的图像处理FPGA开发经验,技术能力与岗位需求高度契合,综合匹配度极高。",
"key_strengths": [
"核心技能完全覆盖,具备4.5年图像处理ISP算法及FPGA pipeline开发经验,远超JD要求的3年",
"技术栈丰富且深厚,熟练掌握Verilog、高速接口(MIPI\/PCIE等)及多种FPGA平台,具备复杂系统架构规划能力",
"职业稳定性极佳,最近一段工作经历超4年且职责持续扩大,整体工作年限达16年"
],
"key_concerns": [
"岗位明确要求大小周(早9晚9),候选人未明确表态是否接受该工作节奏",
"候选人期望薪资下限(30K)触及岗位预算上限,需确认最终薪资结构及可协商空间"
],
"recommendation_summary": "候选人技术实力强劲且经验高度匹配,稳定性优秀,薪资期望在预算边缘但可沟通。虽节奏匹配信息缺失,但不影响其作为高优技术人才的推荐,建议推进面试并重点沟通工作节奏与薪资细节。"
},
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"item": "中性基准",
"score_change": 50
},
{
"item": "核心要求:图像处理\/信号处理算法FPGA开发(要求3年以上)",
"score_change": 20,
"evidence": "在美祥生物有4.5年ISP算法研究及FPGA实现经验,搭建图像处理pipeline,高度满足"
},
{
"item": "核心要求:Verilog及高速接口(MIPI\/PCIE等)",
"score_change": 10,
"evidence": "熟练掌握Verilog,简历明确列出MIPI、PCIE等高速接口经验及实际项目应用"
},
{
"item": "核心要求:大规模逻辑设计与调试",
"score_change": 5,
"evidence": "16年FPGA经验,有基础平台架构规划及复杂信号链路设计经验"
},
{
"item": "加分技能与项目证据",
"score_change": 5,
"evidence": "具备Linux驱动、RTOS等扩展技能,项目涉及IVD高速数据采集及机器人柔性驱动,复杂度高"
},
{
"item": "经验深度:超出要求1-2年",
"score_change": 3,
"evidence": "图像处理FPGA经验4.5年,超出JD要求的3年约1.5年"
}
],
"jd_requirement": "统招本科以上,3年以上图像处理\/信号处理算法FPGA开发经验;熟练Verilog;熟悉MIPI\/PCIE\/LVDS等高速接口;具备大规模电路逻辑设计和调试经验;英语阅读能力。",
"resume_fulfillment": "完全满足。拥有16年研发经验,其中近4.5年专注于医疗IVD设备的图像处理ISP算法及FPGA pipeline开发。熟练掌握Verilog及各类高速接口,具备Zynq\/Altera等多平台开发经验,英语CET6。"
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"adjusted_score": 74,
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"item": "中性基准",
"score_change": 50
},
{
"item": "最近一段正式工作超过24个月",
"score_change": 25,
"evidence": "最近一段工作(美祥生物)从2022.04至今,任职约52个月,远超24个月阈值"
},
{
"item": "内部晋升或职责持续扩大",
"score_change": 5,
"evidence": "在美祥生物后期负责产品技术平台规划与设计,职责范围扩大"
}
],
"jd_requirement": "JD未明确稳定性要求,按通用标准评估:最近一段工作任职时长及历史任职稳定性。",
"resume_fulfillment": "稳定性极佳。最近一段工作任职超4年,且历史5段工作经历均保持较长任期(2.7年至4.5年不等),无频繁跳槽记录,当前仍在职。"
},
{
"name": "salary_match",
"raw_score": 90,
"confidence_level": "high",
"adjusted_score": 90,
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"score_breakdown": [
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"item": "中性基准",
"score_change": 50
},
{
"item": "期望薪资位于预算范围内",
"score_change": 40,
"evidence": "候选人期望30-35K,岗位预算22-30K,最低期望30K刚好触及预算上限,属于预算范围内"
}
],
"jd_requirement": "岗位薪资预算为 22-30K。",
"resume_fulfillment": "候选人期望薪资为 30-35K。最低期望30K位于岗位预算上限,匹配度较高,但需确认其薪资底线及岗位定级。"
},
{
"name": "pace_match",
"raw_score": 60,
"confidence_level": "low",
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"score_breakdown": [
{
"item": "中性基准",
"score_change": 50
},
{
"item": "期望城市与岗位城市匹配",
"score_change": 10,
"evidence": "候选人期望城市为深圳,与岗位所在地深圳一致"
}
],
"jd_requirement": "工作地点:深圳;工作节奏:大小周(早9晚9),需接受研发攻关期加班和一定工作压力。",
"resume_fulfillment": "期望城市匹配。但候选人未明确说明是否接受大小周及早9晚9的工作节奏,关键接受意愿缺失,无法可靠判断节奏匹配度。"
},
{
"name": "communication",
"raw_score": 90,
"confidence_level": "high",
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"item": "中性基准",
"score_change": 50
},
{
"item": "模块清晰、阅读顺序合理",
"score_change": 10,
"evidence": "简历包含个人优势、工作经历、项目经历、教育经历等标准模块,结构清晰"
},
{
"item": "任职时间、职位、公司和项目字段完整",
"score_change": 10,
"evidence": "各段工作经历的时间、公司、职位均完整无缺失"
},
{
"item": "能说明背景、个人动作和结果",
"score_change": 10,
"evidence": "项目经历中详细描述了ISP算法pipeline搭建、高速数据采集等具体动作及成果"
},
{
"item": "技能、经历、项目和时间线一致",
"score_change": 10,
"evidence": "个人优势中列出的技能与工作经历中的项目内容高度一致,时间线连续无矛盾"
}
],
"jd_requirement": "此项为简历信息表达质量评估,JD无直接要求。",
"resume_fulfillment": "简历呈现质量高。结构清晰,字段完整,技术栈与项目经验描述详实且一致,能清晰展现候选人的技术深度与项目成果。"
}
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"match_score": 89.1,
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"候选人未明确说明是否接受岗位要求的‘大小周(早9晚9)’及加班安排",
"候选人未提供具体的到岗时间"
],
"bonus_items": [
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"reason": "技术匹配度极高,具备4.5年高度相关的图像处理FPGA开发经验,技术栈全面且深厚",
"bonus_impact": 7.5
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"recommendation": "strong_approve",
"recommendation_reason": "候选人技术实力强劲,核心技能与岗位需求高度契合,且具备优秀的职业稳定性。虽然工作节奏(大小周)的接受度尚未明确,但不影响其作为高优技术人才的推荐。建议尽快推进面试,并在后续沟通中确认工作节奏接受度及薪资细节。"
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