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简历初筛 #922

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1-6aa3c992-152395-3c03dbb42543
状态
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创建时间
2026-09-11 17:31:48
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2026-09-11 09:30:22
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922
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产研 周远泽 2026-07-05T16:00:00.000Z FPGA工程师-深圳 2 全职 普通 2026-07-30T16:00:00.000Z 关于朗伯威LAMBERV 高端视觉传感器供应商 | 国家级高新技术企业 | 清华团队 | 高速成长期企业 朗伯威中国官网:www.lamberv.com 任职要求: 1、统招本科以上学历,3年以上图像处理/信号处理算法FPGA开发经验; 2、熟练的掌握掌握Verilog语言; 3、有高速信号调试经验,熟悉MIPI,PCIE,USB等接口;熟悉LVDS; 4、具有大规模电路逻辑设计经验和调试经验,能够解决复杂的时序问题; 5、具备数量阅读英文文档的能力; 6、能接受研发攻关期加班和一定的工作压力。 岗位职责: 1、负责超高分辨率智能工业相机、计算成像传感产品的图像、视觉算法的硬件逻辑实现方案论证; 2、负责FPGA逻辑的设计、开发、调试以及维护等工作; 3、配合软件、硬件工程师进行产品设计开发过程中的软硬件联调和验证; 4、负责FPGA相关文档的撰写和整理。 公司福利 1、办公室咖啡、小零食每日无限量供应; 2、核心团队来自清华大学,公司业务高速健康增长,产品研发采用前沿技术路线,提供有竞争力的职业晋升机会。 3、团队扁平化管理,成员年轻化,只要敢拼敢干,空间不设限; 图像。LVDS 22-30K HC2026070605 67adaef1fe156cbf02573142 00050 [{'name': '周远泽', 'username': 'c945b5g9', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'c945b5g9'}, {'name': '唐汇沙', 'username': 'adb78383', 'status': 1, 'type': 0, 'departments': [3], 'integrate_id': 'adb78383'}] [{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [29], 'integrate_id': 'e3378688'}] [{'name': '杨心杰', 'username': 'e3378688', 'status': 1, 'type': 0, 'departments': [29], 'integrate_id': 'e3378688'}] [{'name': '户孝围', 'username': '3eabb56d', 'status': 1, 'type': 0, 'departments': [22, 4], 'integrate_id': '3eabb56d'}] 社招 深圳-源政创业大厦 3-5年 大小周(早9晚9) 通过 2026-07-05T16:00:00.000Z 已启动 2026-07-05T16:00:00.000Z 105 30 16 8 3 1 7 1 2 未完成 0.5 FPGA 研发 81.15806452
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        "overall_match": "候选人技术能力高度匹配,具备丰富的FPGA开发及高速接口经验,现居深圳,整体匹配度极高。",
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            "核心技能完全覆盖,精通Verilog及MIPI\/PCIE\/LVDS等高速接口",
            "具备图像处理与信号处理算法的FPGA实现经验,项目成果丰富且复杂度高",
            "现居深圳,地点完全匹配,具备中英文双语工作能力"
        ],
        "key_concerns": [
            "最近一段工作经历仅3个月,需关注短期离职原因及后续稳定性",
            "期望薪资面议,当前薪资35K略超岗位预算上限",
            "未明确表态是否接受大小周、早9晚9及研发攻关期的高强度加班"
        ],
        "recommendation_summary": "技术实力雄厚,项目经验与岗位需求高度契合,地点匹配。虽近期工作变动频繁且部分节奏与薪资信息缺失,但不影响整体强烈推荐。"
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            "jd_requirement": "统招本科以上,3年以上图像\/信号处理算法FPGA经验;精通Verilog;熟悉MIPI\/PCIE\/USB\/LVDS等高速接口;具备大规模逻辑设计与复杂时序解决能力;熟练阅读英文文档。",
            "resume_fulfillment": "完全满足。拥有马里兰大学硕士及河海大学本科背景;具备视频图像采集(MIPI)及信号处理(802.11\/维特比译码)的FPGA实现经验;精通Verilog\/VHDL,熟练掌握MIPI、PCIE、LVDS等高速接口;具备跨时钟域及复杂AXI总线逻辑设计经验;有美国留学背景,英语能力优秀。经验深度远超JD要求。"
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            "raw_score": 40,
            "confidence_level": "medium",
            "jd_requirement": "JD未明确说明,依据通用稳定性规则评估正式工作任职时长模式。",
            "resume_fulfillment": "候选人历史有两段较长正式工作(5年4个月、1年5个月),历史均值大于2年。但最近一段工作(深圳麦科信)任职仅3个月即离职,触发稳定性扣分规则。当前空档期不足1个月,不扣分。"
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            "jd_requirement": "岗位预算 22-30K。",
            "resume_fulfillment": "候选人当前薪资为税前35K\/月,期望薪资填写为“面议”。因未明确具体期望薪资,无法直接计算匹配度,保持中性基准分,不形成明确薪资风险。"
        },
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            "jd_requirement": "工作地点深圳;大小周(早9晚9);能接受研发攻关期加班和一定工作压力。",
            "resume_fulfillment": "候选人现居深圳,期望工作地为广东省,地点完全匹配(+10分)。但未明确说明是否接受大小周、早9晚9及高强度加班安排,关键接受意愿缺失,置信度降为low。"
        },
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            "jd_requirement": "此项为简历信息表达质量评估,JD无直接要求。",
            "resume_fulfillment": "简历结构清晰,模块划分合理;任职时间、职位、项目等关键字段完整;项目描述能清晰说明背景、个人动作和结果,技术栈与项目经历高度一致,无矛盾信息,呈现质量极高。"
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