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    "basic_info": {
        "name": "宋宜珂",
        "gender": "男",
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        "work_years": "8.0"
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    "education": [
        {
            "school": "河南理工万方科技大学院",
            "major": "电子信息工程",
            "degree": "本科",
            "graduation_year": "2018"
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    "job_intention": {
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        "expected_salary": "",
        "expected_city": "深圳",
        "availability": ""
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    "skills": [
        "FPGA开发",
        "Vivado",
        "Modelsim",
        "Questasim",
        "Matlab",
        "Xilinx Kintex\/Virtex",
        "DDR3\/DDR4高速存储",
        "Microblaze软硬核联合开发",
        "HDMI2.0",
        "LVDS",
        "AXI",
        "SPI",
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        "TCP\/IP",
        "10G\/25G高速网口开发",
        "MDDP\/Binary\/STEP\/FAST行情协议",
        "Mellanox\/Solarflare\/Exanic网卡",
        "Verilog",
        "VHDL"
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    "work_experience": [
        {
            "company": "深圳华锐分布式技术股份有限公司",
            "position": "FPGA开发",
            "duration": "2021\/08 - Present",
            "description": "1.数据中心FPGA低延迟方案设计与研发，针对金融高频交易场景，定制开发沪深两市行情硬件加速FPGA方案，负责方案架构设计、逻辑编码、仿真调试及性能优化。2.参与Smartnic、DPU相关的FPGA技术研发工作，依托Mellanox、Solarflare智能网卡，完成FPGA逻辑开发和时序优化，助力前沿FPGA技术在金融业务中顺利实现产品化落地。3.全程参与需求评审、模块设计、版本迭代到上线运维，协同软件、完成软硬件联调，保障产品性能与稳定性达到行业领先水平。业绩：1.主导沪深两市行情FPGA硬件加速产品开发，完成行情协议解码重构，通过时序优化与算法优化，使行情处理延时较传统软件方案降低70%以上，产品在券商POC测试中多次斩获性能第一；2.完成FPGA网卡逻辑开发与时序收敛，解决TCP\/UDP分片解析、数据乱序等核心问题，保障高频交易行情数据传输的稳定性，产品已在数十家券商客户上线，为公司带来显著营收增长。"
        },
        {
            "company": "深圳视显光电科技有限公司",
            "position": "FPGA开发",
            "duration": "2017\/12 - 2021\/02",
            "description": "1.负责FPGA逻辑设计、编码、仿真与硬件调试，主导视频图像处理类FPGA项目开发，涵盖HDMI接口、UHD信号生成、背光驱动等核心模块，确保项目需求高效落地。2.基于Xilinx FPGA芯片，完成Microblaze软硬核联合开发，优化FPGA逻辑架构，解决高速接口、时序约束、信号传输等技术难题，提升产品性能。3.协同软件、硬件团队完成FPGA软硬件联调，参与项目评审与开发流程优化，推动FPGA产品从研发到量产的全流程落地，保障产品稳定性与兼容性。"
        }
    ],
    "project_experience": [
        {
            "name": "行情硬件加速项目",
            "role": "负责人",
            "duration": "2021\/08 - Present",
            "description": "项目背景：高频量化交易对行情信息延时要求严苛，需基于FPGA开发超低延迟行情硬件加速方案。核心职责：1.主导沪深双市场、多版本FPGA行情加速产品全流程开发；2.负责FPGA时序约束与优化；3.主导行情协议FPGA解码重构；4.协同软件团队完成接口适配。技术难点与解决方案：解决TCP\/UDP分片数据解析丢包乱序、行情解码延时过高、大型FPGA芯片资源紧张、时序收敛困难、客户字段需求差异大、择优算法优化、组播延时与打包效率优化、超大级存储设计等难题。业绩：产品性能、稳定性均达到行业领先，券商POC测试多次获性能第一，已在30+家券商客户上线应用；行情处理延时稳定在微秒级，客户满意度达95%以上。"
        },
        {
            "name": "HDMI 接口设计",
            "role": "FPGA开发",
            "duration": "2020\/04 - 2021\/07",
            "description": "项目背景：公司高端视频播放器产品需支持4K@60Hz高清视频输入，需基于FPGA开发高性能HDMI2.0接口。核心职责：负责FPGA全流程开发，包括架构设计、代码编写、IP二次开发、仿真及硬件调试。技术难点与解决方案：解决Xilinx官方IP单路输入限制、视频分辨率切换卡顿失真、HDR信息解码不完整等难题。业绩：成功应用于公司视频采集卡产品，占据同类产品15%市场份额。"
        },
        {
            "name": "UHD 信号发生器",
            "role": "FPGA开发",
            "duration": "2019\/05 - 2020\/03",
            "description": "项目背景：为满足公司内部产品测试及大屏厂客户测试需求，开发支持多信号源、多输出接口的UHD信号发生器。核心职责：负责FPGA软件架构设计、模块整合，基于Microblaze软核与SDK开发HDMI IP，完成DDR3高速存储接口优化。技术难点与解决方案：解决DDR3高速存储信号传输不稳定导致4K信号输出失真问题。业绩：成为公司内部测试核心设备，降低测试成本30%，为10+家大屏厂提供测试支持。"
        },
        {
            "name": "Local_Dimming 背光驱动",
            "role": "FPGA开发",
            "duration": "2018\/05 - 2019\/08",
            "description": "项目背景：高端液晶显示器需通过分区背光调节提升对比度、降低功耗，需基于FPGA实现Local_Dimming算法与LED驱动芯片控制。核心职责：负责FPGA逻辑开发、LED驱动芯片控制逻辑编写、算法FPGA实现及硬件调试。技术难点与解决方案：解决分区亮度调节不同步问题，实现精准同步调节。业绩：应用于公司高端液晶显示器产品，使对比度提升40%以上，背光功耗降低25%，推动产品销量同比增长30%。"
        }
    ],
    "certifications": [],
    "self_evaluation": "1、资深FPGA全栈开发能力：深耕FPGA开发多年，主攻视频图像处理、金融硬件加速两大核心赛道，可独立主导FPGA项目全流程落地，精通Vivado、Modelsim、Questasim、Matlab等全套开发仿真工具。2、高速接口与存储架构功底扎实：精通Xilinx Kintex\/Virtex系列FPGA硬件架构，具备DDR3\/DDR4高速存储、Microblaze软硬核联合开发实战能力，熟练驾驭各类通信协议及10G\/25G高速网口开发。3、金融低延迟FPGA专项核心优势：拥有金融行业专属FPGA开发经验，熟悉交易所行情协议及高端高性能网卡，擅长时序收敛、链路优化，可定制化搭建极致低延迟硬件加速方案。"
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