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#606
记录详情
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2026-08-02 16:22:56
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606
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2026-08-02 08:20:48
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万邦宇
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"email": "771743719@qq.com",
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"birth_date": null,
"location": null,
"work_years": "2.7"
},
"education": [
{
"school": "北京航空航天大学",
"major": "电子信息",
"degree": "硕士",
"graduation_year": "2023"
},
{
"school": "哈尔滨工业大学",
"major": "测控技术与仪器",
"degree": "本科",
"graduation_year": "2018"
}
],
"job_intention": {
"expected_position": "FPGA开发",
"expected_salary": null,
"expected_city": "上海",
"availability": null
},
"skills": [
"FPGA\/SOC 选型、开发、仿真、调试",
"高速接口协议 (SerDes, MIPI, HDMI2.0, 以太网, PCIe, JESD204B等)",
"PS端嵌入式裸核与RTOS (FreeRTOS) 开发",
"数字信号处理\/通信\/计算机\/硬件\/光学\/图像处理",
"MATLAB, C, SystemVerilog, Python",
"Linux开发环境",
"Xilinx Zynq MPSoC, Versal, UltraScale+ FPGA",
"ISP算法开发与优化",
"AXI, DDR3\/DDR4 MIG, VDMA",
"LWIP, UDP, TCP\/IP, DHCP, ARP",
"时序优化与高资源占用率逻辑开发"
],
"work_experience": [
{
"company": "以诺康医疗科技(苏州)股份有限公司",
"position": "FPGA高级工程师",
"duration": "2025\/11 - Present",
"description": "负责FPGA\/SOC的选型、开发、仿真、调试工作,主导项目算法相关软硬件的架构设计。"
},
{
"company": "苏州光格科技股份有限公司",
"position": "FPGA工程师",
"duration": "2023\/03 - 2025\/11",
"description": "1.负责项目的SOC选型,以及配套外围芯片的实现方案与器件选型,主导项目算法相关软硬件的架构设计。\n2.参与4k60帧高清图像实时ISP算法的研究,负责算法的具体落地,协同硬件完成SOC引脚规划设计。\n3.完成SOC上FPGA和嵌入式的具体开发工作,包括PL\/PS高速接口驱动与外围芯片驱动,ISP算法优化落地,控制逻辑等。\n4.高低速接口驱动开发,包括以太网相关协议、高速MIPI驱动、HDMI2.0协议解包打包等。\n5.产出相关文档,指导项目其他下级工程师的部分工作。"
}
],
"project_experience": [
{
"name": "内窥镜",
"role": "FPGA 高级工程师",
"duration": "2025\/11 - Present",
"description": "项目概况:4k 60帧高清3d腹腔内窥镜的开发。\n本人职责:负责FPGA与嵌入式的代码开发与架构设计,审核硬件引脚设计,研究落地ISP算法。\n项目成果:\n1.对4k60帧高分辨率实时ISP进行了研究,设计了全套ISP算法。\n2.基于xczu15eg soc进行开发,在PL端落地isp算法,使用systemverilog搭建tb进行高覆盖率测试。实现了cmos配置驱动、MIPI驱动、基于serdes纯代码实现hdmi2.0\/1.0驱动与VGA时序控制。纯代码实现ddr4 mig核的控制与图像数据读写仲裁。\n3.在PS端使用freertos与裸核结合异构架构,实现用户ui界面、dhcp客户端、qflash在线更新、DP驱动等。\n4.实现其他低速接口及pl端基于udp\/ip协议的相关功能。"
},
{
"name": "电缆故障定位系统",
"role": "FPGA 工程师",
"duration": "2025\/03 - 2025\/08",
"description": "项目概况:基于行波阈值触发和工频电流FFT成分分析来确定电缆故障的优先级,再根据优先级上报故障的检测系统。\n本人职责:zynq pl端的代码开发,算法优化落地,以及设计pl\/ps之间的数据交互机制。\n项目成果:\n1.编写外围硬件驱动。\n2.设计2000阶FIR带通滤波器,通过时分复用与对称性降低99%以上DSP消耗。\n3.设计复杂的优先级判定机制。\n4.设计pl\/ps数据交互方案,使用axi hd和axi hp接口。\n5.设计比大小累计加分的排序算法。\n6.zynq7020资源占比达80%以上,通过多种手段节省资源并降低时序压力。"
},
{
"name": "FPGA 高速采集板卡",
"role": "FPGA 开发",
"duration": "2024\/03 - 2024\/12",
"description": "项目概述:基于复杂光学系统的先进FPGA高速采集算法板,使用两片xilinx versal xcvm1402先进FPGA进行开发。\n本人职责:fpga开发调试,主导架构设计,参与算法设计,负责算法优化落地。\n项目成果:\n1.外设部分:实现2G采样率DAC\/ADC配置驱动,8通道JESD204B确定性延迟调试,25G以太网通信等。\n2.数据处理部分:实现8路24Gbps采样数据超高带宽的混频解调、低通滤波抽取、匹配滤波、分段FFT等数据处理,进行CDC处理及复杂计算优化。\n3.自由度:混频系数、滤波系数等多种参数实现上位机自由可调。\n4.同步:通过物理约束和调试实现DAC扫频和ADC采集的皮秒级同步。"
}
],
"certifications": [],
"self_evaluation": "开发效率高,学习新业务的能力非常强。具有5个以上完整项目开发调试经验,有指导新人开发的经验。熟练使用xilinx的高端soc,有高计算带宽\/高资源占用\/高时钟频率逻辑的开发经验。"
}
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