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陈

陈招勇resume_parse_logs.name

初筛完成 1-6a8d4550-153830-ed76546a9cbc
18586475574resume_parse_logs.phone 本科 · 绥化学院resume_fetch_logs.raw_data.data._widget_1704704608270 / resume_fetch_logs.raw_data.data._widget_1704704608271
FPGA工程师-深圳 resume_fetch_logs.raw_data.data._widget_1704718033203 下载简历
综合评分 55 match_score
公式得分 56
公式计算
63*50%/0.95 + 30*20%/0.95 + 60*20%/0.95 + 75*5%/0.95 = 56分
推荐结论：谨慎待定 recommendation
关键优势 summary.key_strengths
  • 具备Zynq SoC软硬件协同开发及信号处理算法工程化经验
  • 当前所在地为深圳，满足工作地点要求
主要顾虑 summary.key_concerns
  • 缺乏Verilog语言、大规模电路逻辑设计及MIPI/PCIE/LVDS等高速接口的直接证据
  • 最近一段正式工作任职仅5个月，历史跳槽较频繁，稳定性存在风险
  • 简历中工作经历时间存在明显异常（如2026/03），需核实
推荐总结 summary.recommendation_summary
候选人技术栈偏向嵌入式软件与驱动，与FPGA核心要求存在差距；稳定性得分较低且简历时间线存疑，建议谨慎推进并进一步核实技术深度与离职原因。
JD 要求 dimensions.tech_power.jd_requirement
硬性要求
3年以上图像处理/信号处理算法FPGA开发经验；熟练掌握Verilog；熟悉MIPI/PCIE/USB/LVDS等高速接口；具备大规模电路逻辑设计及复杂时序解决能力。
简历满足情况 medium dimensions.tech_power.resume_fulfillment
63 公式 33
公式计算
63*50%/0.95 = 33分
候选人具备Zynq-7020 PL侧信号处理算法（FFT/DDS）实现经验及摄像头串行器/解串器驱动经验，部分满足信号处理与高速接口需求。但简历未明确提及Verilog语言、大规模逻辑设计及MIPI/PCIE/LVDS等核心FPGA技能，技术栈更偏向嵌入式软件与底层驱动，核心FPGA能力证据不足。
JD 要求 dimensions.stability.jd_requirement
稳定性
未明确说明，按常规稳定性标准评估（最近一段任职时长及历史平均任职时长）。
简历满足情况 medium dimensions.stability.resume_fulfillment
30 公式 6
公式计算
30*20%/0.95 = 6分
基于当前时间（2026年8月）推算，候选人最近一段工作（世格赛思）任职仅约5个月。历史正式工作平均任职约1.8年，存在频繁跳槽现象。且简历时间线存在明显异常（如2026/03），稳定性风险较高。
JD 要求 dimensions.salary_match.jd_requirement
薪资匹配
22-30K
简历满足情况 low dimensions.salary_match.resume_fulfillment
信息不足 （50）
候选人未在简历中提供期望薪资，信息缺失，无法评估薪资匹配度。
JD 要求 dimensions.pace_match.jd_requirement
节奏匹配
深圳办公；大小周(早9晚9)；能接受研发攻关期加班和一定的工作压力。
简历满足情况 medium dimensions.pace_match.resume_fulfillment
60 公式 13
公式计算
60*20%/0.95 = 13分
候选人当前位于深圳，满足地点要求。但未明确说明是否接受大小周、早9晚9及高强度加班安排，节奏匹配度存在信息缺失。
JD 要求 dimensions.communication.jd_requirement
简历呈现
此项为简历信息表达质量评估，JD无直接要求。
简历满足情况 high dimensions.communication.resume_fulfillment
75 公式 4
公式计算
75*5%/0.95 = 4分
简历模块清晰，专业技能与项目经历描述详实，能体现具体技术动作与成果。但工作经历中“世格赛思”时间标注为“2026/03”，存在明显的时间逻辑错误或笔误，影响信息严谨性。
处理概览
当前状态 初筛完成
投递时间 08-25 15:33:44
初筛时间 08-25 07:36
AI 模型 qwen3.7-plus
查看原始日志
简历获取
ID: 772
简历解析
ID: 839
简历初筛
ID: 815
JD 分析 jd_analysis
维度评分 dimensions
硬性要求 dimensions.tech_power.raw_score
63
公式 33
公式计算
63*50%/0.95 = 33分
稳定性 dimensions.stability.raw_score
30
公式 6
公式计算
30*20%/0.95 = 6分
薪资匹配 dimensions.salary_match.raw_score
信息不足
节奏匹配 dimensions.pace_match.raw_score
60
公式 13
公式计算
60*20%/0.95 = 13分
简历呈现 dimensions.communication.raw_score
75
公式 4
公式计算
75*5%/0.95 = 4分
硬性要求 medium dimensions.tech_power.resume_fulfillment
63 公式 33
公式计算
63*50%/0.95 = 33分

候选人具备Zynq-7020 PL侧信号处理算法（FFT/DDS）实现经验及摄像头串行器/解串器驱动经验，部分满足信号处理与高速接口需求。但简历未明确提及Verilog语言、大规模逻辑设计及MIPI/PCIE/LVDS等核心FPGA技能，技术栈更偏向嵌入式软件与底层驱动，核心FPGA能力证据不足。

稳定性 medium dimensions.stability.resume_fulfillment
30 公式 6
公式计算
30*20%/0.95 = 6分

基于当前时间（2026年8月）推算，候选人最近一段工作（世格赛思）任职仅约5个月。历史正式工作平均任职约1.8年，存在频繁跳槽现象。且简历时间线存在明显异常（如2026/03），稳定性风险较高。

薪资匹配 low dimensions.salary_match.resume_fulfillment
信息不足 （50）

候选人未在简历中提供期望薪资，信息缺失，无法评估薪资匹配度。

节奏匹配 medium dimensions.pace_match.resume_fulfillment
60 公式 13
公式计算
60*20%/0.95 = 13分

候选人当前位于深圳，满足地点要求。但未明确说明是否接受大小周、早9晚9及高强度加班安排，节奏匹配度存在信息缺失。

简历呈现 high dimensions.communication.resume_fulfillment
75 公式 4
公式计算
75*5%/0.95 = 4分

简历模块清晰，专业技能与项目经历描述详实，能体现具体技术动作与成果。但工作经历中“世格赛思”时间标注为“2026/03”，存在明显的时间逻辑错误或笔误，影响信息严谨性。

综合评分 55 match_score
公式得分 56
公式计算
63*50%/0.95 + 30*20%/0.95 + 60*20%/0.95 + 75*5%/0.95 = 56分
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