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梁

梁龙resume_parse_logs.name

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18394156914resume_parse_logs.phone 本科 · 兰州交通大学resume_fetch_logs.raw_data.data._widget_1704704608270 / resume_fetch_logs.raw_data.data._widget_1704704608271
FPGA工程师-深圳 resume_fetch_logs.raw_data.data._widget_1704718033203 下载简历
综合评分 77 match_score
公式得分 75
公式计算
73*50%/0.8 + 75*20%/0.8 + 80*5%/0.8 + 95*5%/0.8 = 75分
推荐结论：通过 recommendation
关键优势 summary.key_strengths
  • 5年FPGA全流程开发经验，精通Verilog及复杂时序收敛
  • 具备高速信号处理、ADC/DAC及大规模数据调度落地经验，项目成果达国际先进水平
  • 职业稳定性极佳，两段正式工作经历均超过4年
主要顾虑 summary.key_concerns
  • 缺乏图像处理算法及LVDS/MIPI等工业相机常用接口经验，与岗位核心业务场景存在差异
  • 期望薪资30-50K，略高于岗位预算上限（22-30K）
  • 现居兰州，未明确是否接受深圳线下办公、大小周及高强度加班
推荐总结 summary.recommendation_summary
候选人FPGA底层技术过硬且稳定性高，但核心业务场景（图像/LVDS）不匹配，且异地、薪资及工作节奏需进一步核实，建议作为备选推进面试以确认业务迁移能力与意愿。
JD 要求 dimensions.tech_power.jd_requirement
硬性要求
3年以上图像处理/信号处理算法FPGA经验，精通Verilog，熟悉MIPI/PCIE/USB/LVDS等高速接口，具备大规模逻辑设计与复杂时序解决能力。筛选标准强调图像与LVDS。
简历满足情况 high dimensions.tech_power.resume_fulfillment
73 公式 46
公式计算
73*50%/0.8 = 46分
具备5年信号处理FPGA经验，精通Verilog、Zynq/MPSoc及高速ADC/DAC/光纤接口，时序与项目落地能力强。但完全缺乏图像处理经验及LVDS/MIPI等视觉相机核心接口经验，业务场景不匹配。
JD 要求 dimensions.stability.jd_requirement
稳定性
未明确说明，默认评估任职时长与稳定性模式。
简历满足情况 high dimensions.stability.resume_fulfillment
75 公式 19
公式计算
75*20%/0.8 = 19分
最近一段任职5年（2021.7至今），此前一段任职4年（2017.7-2021.6），历史均值远超3年，当前在职无空档期，稳定性极佳。
JD 要求 dimensions.salary_match.jd_requirement
薪资匹配
期望薪资范围22-30K。
简历满足情况 high dimensions.salary_match.resume_fulfillment
80 公式 5
公式计算
80*5%/0.8 = 5分
候选人期望薪资30-50K，下限刚好触及岗位预算上限，整体期望略高于预算，存在一定薪资谈判空间与风险。
JD 要求 dimensions.pace_match.jd_requirement
节奏匹配
深圳线下办公，大小周（早9晚9），期望到岗2026-07-31。
简历满足情况 low dimensions.pace_match.resume_fulfillment
信息不足 （50）
候选人现居兰州，简历未说明是否接受深圳工作、大小周及高强度加班，也未提供明确到岗时间，关键节奏信息缺失。
JD 要求 dimensions.communication.jd_requirement
简历呈现
此项为简历信息表达质量评估，JD无直接要求。
简历满足情况 high dimensions.communication.resume_fulfillment
95 公式 6
公式计算
95*5%/0.8 = 6分
简历结构清晰，模块划分合理，任职与项目时间线完整一致；项目描述包含明确的背景、技术动作与量化成果（如精度优于0.1°），表达专业且极具说服力。
处理概览
当前状态 初筛完成
投递时间 07-28 19:21:38
初筛时间 07-28 11:23
AI 模型 qwen3.7-plus
查看原始日志
简历获取
ID: 408
简历解析
ID: 445
简历初筛
ID: 426
JD 分析 jd_analysis
维度评分 dimensions
硬性要求 dimensions.tech_power.raw_score
73
公式 46
公式计算
73*50%/0.8 = 46分
稳定性 dimensions.stability.raw_score
75
公式 19
公式计算
75*20%/0.8 = 19分
薪资匹配 dimensions.salary_match.raw_score
80
公式 5
公式计算
80*5%/0.8 = 5分
节奏匹配 dimensions.pace_match.raw_score
信息不足
简历呈现 dimensions.communication.raw_score
95
公式 6
公式计算
95*5%/0.8 = 6分
硬性要求 high dimensions.tech_power.resume_fulfillment
73 公式 46
公式计算
73*50%/0.8 = 46分

具备5年信号处理FPGA经验，精通Verilog、Zynq/MPSoc及高速ADC/DAC/光纤接口，时序与项目落地能力强。但完全缺乏图像处理经验及LVDS/MIPI等视觉相机核心接口经验，业务场景不匹配。

稳定性 high dimensions.stability.resume_fulfillment
75 公式 19
公式计算
75*20%/0.8 = 19分

最近一段任职5年（2021.7至今），此前一段任职4年（2017.7-2021.6），历史均值远超3年，当前在职无空档期，稳定性极佳。

薪资匹配 high dimensions.salary_match.resume_fulfillment
80 公式 5
公式计算
80*5%/0.8 = 5分

候选人期望薪资30-50K，下限刚好触及岗位预算上限，整体期望略高于预算，存在一定薪资谈判空间与风险。

节奏匹配 low dimensions.pace_match.resume_fulfillment
信息不足 （50）

候选人现居兰州，简历未说明是否接受深圳工作、大小周及高强度加班，也未提供明确到岗时间，关键节奏信息缺失。

简历呈现 high dimensions.communication.resume_fulfillment
95 公式 6
公式计算
95*5%/0.8 = 6分

简历结构清晰，模块划分合理，任职与项目时间线完整一致；项目描述包含明确的背景、技术动作与量化成果（如精度优于0.1°），表达专业且极具说服力。

综合评分 77 match_score
公式得分 75
公式计算
73*50%/0.8 + 75*20%/0.8 + 80*5%/0.8 + 95*5%/0.8 = 75分
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