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赵

赵瑜resume_parse_logs.name

初筛完成 1-6a8066d0-152061-8ec37e1b5680
本科 · 安徽大学resume_fetch_logs.raw_data.data._widget_1704704608270 / resume_fetch_logs.raw_data.data._widget_1704704608271
FPGA工程师-深圳 resume_fetch_logs.raw_data.data._widget_1704718033203 下载简历
综合评分 85 match_score
公式得分 87
公式计算
100*50% + 65*20% + 95*5% + 70*20% + 95*5% = 87分
推荐结论：强烈推荐 recommendation
关键优势 summary.key_strengths
  • 具备近4年FPGA开发经验，深度参与图像处理与信号处理算法的硬件逻辑实现
  • 熟练掌握Verilog及高速接口（LVDS/Serdes），有从0到1复杂项目量产落地经验
  • 期望薪资22-24K，完全落在岗位22-30K的预算范围内
主要顾虑 summary.key_concerns
  • 最近一段工作经历任职约20个月，稳定性需结合历史履历综合看待
  • 简历未明确表态是否接受大小周（早9晚9）及研发攻关期加班的工作节奏
推荐总结 summary.recommendation_summary
技术能力与岗位需求高度契合，项目成果丰富且已量产，薪资匹配度好，综合分达85.1，建议强力推进。
JD 要求 dimensions.tech_power.jd_requirement
硬性要求
统招本科以上，3年以上图像/信号处理FPGA经验；熟练Verilog；熟悉高速接口（MIPI/PCIE/USB/LVDS等）及大规模逻辑时序调试；能阅读英文文档。
简历满足情况 high dimensions.tech_power.resume_fulfillment
100 公式 50
公式计算
100*50% = 50分
候选人安徽大学通信工程本科，具备近4年FPGA开发经验（光峰科技图像处理+中兴通讯信号处理）。熟练掌握Verilog、时序约束与收敛，有丰富的LVDS、Serdes、XGMII等高速接口调试经验。具备CET-4证书，有从0到1复杂项目量产落地经验，核心技术高度满足。
JD 要求 dimensions.stability.jd_requirement
稳定性
JD未明确稳定性要求，依据通用规则评估正式工作任职时长模式。
简历满足情况 medium dimensions.stability.resume_fulfillment
65 公式 13
公式计算
65*20% = 13分
候选人有三段正式工作经历。最近一段（光峰科技）任职约20个月（>12且≤24个月），历史两段正式工作（卡莱特3年、中兴2年）平均任职年限为2.5年（>2且≤3年），符合稳定性加分规则。当前空档期不足12个月，不扣分。
JD 要求 dimensions.salary_match.jd_requirement
薪资匹配
岗位薪资预算为22-30K。
简历满足情况 high dimensions.salary_match.resume_fulfillment
95 公式 5
公式计算
95*5% = 5分
候选人明确期望薪资为22-24K，完全位于岗位预算范围内，薪资匹配度极高，无商务沟通风险。
JD 要求 dimensions.pace_match.jd_requirement
节奏匹配
工作地点深圳，大小周（早9晚9），需接受研发攻关期加班和一定工作压力。
简历满足情况 medium dimensions.pace_match.resume_fulfillment
70 公式 14
公式计算
70*20% = 14分
候选人当前及历史工作均位于深圳，地点完全匹配。具有相似硬件研发及量产交付环境经验。但简历未明确表态是否接受大小周及高强度加班节奏，该部分信息缺失，不扣分但需后续沟通确认。
JD 要求 dimensions.communication.jd_requirement
简历呈现
此项为简历信息表达质量评估，JD无直接要求。
简历满足情况 high dimensions.communication.resume_fulfillment
95 公式 5
公式计算
95*5% = 5分
简历模块清晰，阅读顺序合理；任职时间、职位、公司字段完整；项目经验详实，能清晰说明背景、个人动作、技术细节和量化结果；技能、经历和时间线高度一致，呈现质量极佳。
处理概览
当前状态 初筛完成
投递时间 08-15 21:17:05
初筛时间 08-15 13:19
AI 模型 qwen3.7-plus
查看原始日志
简历获取
ID: 683
简历解析
ID: 738
简历初筛
ID: 716
JD 分析 jd_analysis
维度评分 dimensions
硬性要求 dimensions.tech_power.raw_score
100
公式 50
公式计算
100*50% = 50分
稳定性 dimensions.stability.raw_score
65
公式 13
公式计算
65*20% = 13分
薪资匹配 dimensions.salary_match.raw_score
95
公式 5
公式计算
95*5% = 5分
节奏匹配 dimensions.pace_match.raw_score
70
公式 14
公式计算
70*20% = 14分
简历呈现 dimensions.communication.raw_score
95
公式 5
公式计算
95*5% = 5分
硬性要求 high dimensions.tech_power.resume_fulfillment
100 公式 50
公式计算
100*50% = 50分

候选人安徽大学通信工程本科，具备近4年FPGA开发经验（光峰科技图像处理+中兴通讯信号处理）。熟练掌握Verilog、时序约束与收敛，有丰富的LVDS、Serdes、XGMII等高速接口调试经验。具备CET-4证书，有从0到1复杂项目量产落地经验，核心技术高度满足。

稳定性 medium dimensions.stability.resume_fulfillment
65 公式 13
公式计算
65*20% = 13分

候选人有三段正式工作经历。最近一段（光峰科技）任职约20个月（>12且≤24个月），历史两段正式工作（卡莱特3年、中兴2年）平均任职年限为2.5年（>2且≤3年），符合稳定性加分规则。当前空档期不足12个月，不扣分。

薪资匹配 high dimensions.salary_match.resume_fulfillment
95 公式 5
公式计算
95*5% = 5分

候选人明确期望薪资为22-24K，完全位于岗位预算范围内，薪资匹配度极高，无商务沟通风险。

节奏匹配 medium dimensions.pace_match.resume_fulfillment
70 公式 14
公式计算
70*20% = 14分

候选人当前及历史工作均位于深圳，地点完全匹配。具有相似硬件研发及量产交付环境经验。但简历未明确表态是否接受大小周及高强度加班节奏，该部分信息缺失，不扣分但需后续沟通确认。

简历呈现 high dimensions.communication.resume_fulfillment
95 公式 5
公式计算
95*5% = 5分

简历模块清晰，阅读顺序合理；任职时间、职位、公司字段完整；项目经验详实，能清晰说明背景、个人动作、技术细节和量化结果；技能、经历和时间线高度一致，呈现质量极佳。

综合评分 85 match_score
公式得分 87
公式计算
100*50% + 65*20% + 95*5% + 70*20% + 95*5% = 87分
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