唐

唐嘉鑫resume_parse_logs.name

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15060977396resume_parse_logs.phone 本科 · 北京邮电大学resume_fetch_logs.raw_data.data._widget_1704704608270 / resume_fetch_logs.raw_data.data._widget_1704704608271

FPGA工程师-深圳 resume_fetch_logs.raw_data.data._widget_1704718033203 下载简历

综合评分 79 match_score

公式得分 81

公式计算

88*50%/0.95 + 80*20%/0.95 + 60*20%/0.95 + 95*5%/0.95 = 81分

推荐结论：通过 recommendation

关键优势 summary.key_strengths

具备3.5年FPGA开发经验，熟练掌握Verilog及大规模逻辑设计与时序收敛
有100G/40G高速接口及复杂系统量产交付经验，项目成果量化清晰
明确接受异地工作至深圳，简历结构清晰、表达专业

主要顾虑 summary.key_concerns

过往经验集中于网络DPI与报文处理，缺乏直接的图像处理/视觉算法FPGA开发经验
熟悉Interlaken/DDR等高速接口，但未提及JD要求的MIPI、PCIE、USB、LVDS等接口
未明确说明是否接受大小周及研发攻关期加班，未提供到岗时间

推荐总结 summary.recommendation_summary

候选人技术底子优秀，FPGA核心能力与项目经验高度匹配，综合分达到approve标准。虽场景经验与JD存在部分差异且节奏意愿待确认，但不构成硬性淘汰风险，建议推进面试以核实图像算法迁移能力及加班接受度。

JD 要求 dimensions.tech_power.jd_requirement

硬性要求

3年以上图像处理/信号处理算法FPGA开发经验；熟练掌握Verilog；熟悉MIPI/PCIE/USB/LVDS及高速信号调试；具备大规模逻辑设计与时序问题解决能力。

简历满足情况 high dimensions.tech_power.resume_fulfillment

88 公式 46

公式计算

88*50%/0.95 = 46分

具备3.5年FPGA开发经验，精通Verilog及大规模逻辑设计与时序收敛。有100G/40G高速接口调试及量产经验。但经验主要集中在网络报文处理（DPI），缺乏直接的图像处理/视觉算法经验；高速接口熟悉Interlaken/DDR/Aurora，未提及MIPI/PCIE/USB/LVDS。

JD 要求 dimensions.stability.jd_requirement

稳定性

未明确说明，依据通用标准评估任职稳定性。

简历满足情况 medium dimensions.stability.resume_fulfillment

80 公式 17

公式计算

80*20%/0.95 = 17分

仅有一段正式工作经历（2023.03至今，约3.5年），超过24个月，基础稳定。2024年10月起担任FPGA模块负责人，职责持续扩大，稳定性良好。

JD 要求 dimensions.salary_match.jd_requirement

薪资匹配

22-30K

简历满足情况 low dimensions.salary_match.resume_fulfillment

信息不足（50）

候选人目前薪资20K，期望薪资填写为“面议”，缺乏明确期望薪资信息，无法直接评估匹配度。

JD 要求 dimensions.pace_match.jd_requirement

节奏匹配

深圳工作；大小周(早9晚9)；能接受研发攻关期加班和一定的工作压力。

简历满足情况 medium dimensions.pace_match.resume_fulfillment

60 公式 13

公式计算

60*20%/0.95 = 13分

明确可接受工作地为广东省-深圳，满足地点要求。但未明确说明是否接受大小周、早9晚9及研发加班，未提供到岗时间。

JD 要求 dimensions.communication.jd_requirement

简历呈现

此项为简历信息表达质量评估，JD无直接要求。

简历满足情况 high dimensions.communication.resume_fulfillment

95 公式 5

公式计算

95*5%/0.95 = 5分

简历模块清晰，逻辑严密。项目经历采用STAR法则，详细说明了背景、个人动作、技术栈及量化成果，专业度高，无冗余或矛盾信息。

版本对比

共 2 个版本

版本	解析时间	城市/薪资	综合评分	推荐结论	初筛状态
v2	09-07 15:37	—	81	强烈推荐	成功
v1 当前	09-07 15:35	—	79	通过	成功

处理概览

当前状态初筛完成

投递时间 09-07 15:35:47

初筛时间 09-07 07:38

AI 模型 qwen3.7-plus

查看原始日志

JD 分析 jd_analysis

维度评分 dimensions

硬性要求 dimensions.tech_power.raw_score

公式 46

公式计算

88*50%/0.95 = 46分

稳定性 dimensions.stability.raw_score

公式 17

公式计算

80*20%/0.95 = 17分

薪资匹配 dimensions.salary_match.raw_score

信息不足

节奏匹配 dimensions.pace_match.raw_score

公式 13

公式计算

60*20%/0.95 = 13分

简历呈现 dimensions.communication.raw_score

公式 5

公式计算

95*5%/0.95 = 5分

硬性要求 high dimensions.tech_power.resume_fulfillment

88 公式 46

公式计算

88*50%/0.95 = 46分

稳定性 medium dimensions.stability.resume_fulfillment

80 公式 17

公式计算

80*20%/0.95 = 17分

仅有一段正式工作经历（2023.03至今，约3.5年），超过24个月，基础稳定。2024年10月起担任FPGA模块负责人，职责持续扩大，稳定性良好。

薪资匹配 low dimensions.salary_match.resume_fulfillment

信息不足（50）

候选人目前薪资20K，期望薪资填写为“面议”，缺乏明确期望薪资信息，无法直接评估匹配度。

节奏匹配 medium dimensions.pace_match.resume_fulfillment

60 公式 13

公式计算

60*20%/0.95 = 13分

明确可接受工作地为广东省-深圳，满足地点要求。但未明确说明是否接受大小周、早9晚9及研发加班，未提供到岗时间。

简历呈现 high dimensions.communication.resume_fulfillment

95 公式 5

公式计算

95*5%/0.95 = 5分

简历模块清晰，逻辑严密。项目经历采用STAR法则，详细说明了背景、个人动作、技术栈及量化成果，专业度高，无冗余或矛盾信息。

综合评分 79 match_score

公式得分 81

公式计算

88*50%/0.95 + 80*20%/0.95 + 60*20%/0.95 + 95*5%/0.95 = 81分

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