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孙

孙玉昆resume_parse_logs.name

初筛完成 1-6a6884f3-15c718-b651364ceb04
15039689573resume_parse_logs.phone 硕士 · 北京信息科技大学resume_fetch_logs.raw_data.data._widget_1704704608270 / resume_fetch_logs.raw_data.data._widget_1704704608271
FPGA工程师-深圳 resume_fetch_logs.raw_data.data._widget_1704718033203 下载简历
综合评分 89 match_score
公式得分 89
公式计算
90*50%/0.55 + 80*5%/0.55 = 89分
推荐结论：待定 recommendation
关键优势 summary.key_strengths
  • 精通Verilog及LVDS/高速信号处理，有复杂时序收敛经验
  • 项目经验与岗位高度匹配，有医疗成像及工业相机相关落地成果
主要顾虑 summary.key_concerns
  • 仅有实习经历，不满足JD要求的3年以上社招经验
  • 缺失期望薪资、工作地点接受度及加班意愿等关键信息
推荐总结 summary.recommendation_summary
技术能力匹配度高，但信息覆盖率不足60%，且经验年限与社招要求存在差距，需补充信息后综合评估。
JD 要求 dimensions.tech_power.jd_requirement
硬性要求
3年以上图像处理/信号处理FPGA经验，精通Verilog，熟悉LVDS/高速信号，能解决复杂时序问题
简历满足情况 high dimensions.tech_power.resume_fulfillment
90 公式 82
公式计算
90*50%/0.55 = 82分
精通Verilog，有丰富的LVDS/高速ADC/千兆以太网项目经验，完成312.5MHz高主频时序收敛。但仅有实习经历，无3年正式工作经验。
JD 要求 dimensions.stability.jd_requirement
稳定性
未明确说明，默认考察社招稳定性
简历满足情况 low dimensions.stability.resume_fulfillment
信息不足 （50）
候选人2026年硕士毕业，仅有实习经历，无正式工作经历，无法评估稳定性。
JD 要求 dimensions.salary_match.jd_requirement
薪资匹配
22-30K
简历满足情况 low dimensions.salary_match.resume_fulfillment
信息不足 （50）
候选人未提供期望薪资，无法评估匹配度。
JD 要求 dimensions.pace_match.jd_requirement
节奏匹配
深圳线下办公，大小周(早9晚9)，需接受研发攻关期加班
简历满足情况 low dimensions.pace_match.resume_fulfillment
信息不足 （50）
候选人未提供当前所在城市、是否接受深圳、是否接受大小周及加班意愿，无法评估。
JD 要求 dimensions.communication.jd_requirement
简历呈现
此项为简历信息表达质量评估，JD无直接要求
简历满足情况 high dimensions.communication.resume_fulfillment
80 公式 7
公式计算
80*5%/0.55 = 7分
简历结构清晰，项目数据详实（如120MSPS、312.5MHz等），但求职意向写为FAE，且部分实习时间线存在小瑕疵。
处理概览
当前状态 初筛完成
投递时间 07-28 18:31:16
初筛时间 07-28 10:33
AI 模型 qwen3.7-plus
查看原始日志
简历获取
ID: 345
简历解析
ID: 384
简历初筛
ID: 360
JD 分析 jd_analysis
维度评分 dimensions
硬性要求 dimensions.tech_power.raw_score
90
公式 82
公式计算
90*50%/0.55 = 82分
稳定性 dimensions.stability.raw_score
信息不足
薪资匹配 dimensions.salary_match.raw_score
信息不足
节奏匹配 dimensions.pace_match.raw_score
信息不足
简历呈现 dimensions.communication.raw_score
80
公式 7
公式计算
80*5%/0.55 = 7分
硬性要求 high dimensions.tech_power.resume_fulfillment
90 公式 82
公式计算
90*50%/0.55 = 82分

精通Verilog，有丰富的LVDS/高速ADC/千兆以太网项目经验，完成312.5MHz高主频时序收敛。但仅有实习经历，无3年正式工作经验。

稳定性 low dimensions.stability.resume_fulfillment
信息不足 （50）

候选人2026年硕士毕业，仅有实习经历，无正式工作经历，无法评估稳定性。

薪资匹配 low dimensions.salary_match.resume_fulfillment
信息不足 （50）

候选人未提供期望薪资，无法评估匹配度。

节奏匹配 low dimensions.pace_match.resume_fulfillment
信息不足 （50）

候选人未提供当前所在城市、是否接受深圳、是否接受大小周及加班意愿，无法评估。

简历呈现 high dimensions.communication.resume_fulfillment
80 公式 7
公式计算
80*5%/0.55 = 7分

简历结构清晰，项目数据详实（如120MSPS、312.5MHz等），但求职意向写为FAE，且部分实习时间线存在小瑕疵。

综合评分 89 match_score
公式得分 89
公式计算
90*50%/0.55 + 80*5%/0.55 = 89分
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