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姚

姚源敏resume_parse_logs.name

初筛完成 1-6a72ae44-159ffb-7a8043c777e3
13557169638resume_parse_logs.phone 本科 · 桂林电子科技大学resume_fetch_logs.raw_data.data._widget_1704704608270 / resume_fetch_logs.raw_data.data._widget_1704704608271
FPGA工程师-深圳 resume_fetch_logs.raw_data.data._widget_1704718033203 下载简历
综合评分 81 match_score
公式得分 81
公式计算
95*50%/0.8 + 40*20%/0.8 + 95*5%/0.8 + 85*5%/0.8 = 81分
推荐结论：强烈推荐 recommendation
关键优势 summary.key_strengths
  • 核心FPGA技能完全覆盖，具备5年大规模逻辑设计与高速接口（PCIE/100GE等）调试经验
  • 期望薪资28-30K完全在岗位预算22-30K范围内，薪资匹配度极高
  • 简历结构清晰，项目经历详实，技术表达专业，具备良好的工程文档能力
主要顾虑 summary.key_concerns
  • 缺乏直接的图像处理/信号处理算法FPGA开发经验，过往经验偏向网络安全与半导体测试设备
  • 最近一段工作任职仅约6个月，历史平均任职2.5年，稳定性存在一定波动风险
  • 未明确表态是否接受大小周及早9晚9的工作节奏，未提供预计到岗时间及英文文档阅读能力证明
推荐总结 summary.recommendation_summary
候选人技术能力高度匹配，薪资期望合理，简历呈现优秀。虽缺乏直接的图像处理算法FPGA经验且近期任职较短，但底层FPGA能力扎实且可迁移，综合匹配分达81.1，整体置信度0.76，强烈推荐推进面试。
JD 要求 dimensions.tech_power.jd_requirement
硬性要求
3年以上图像处理/信号处理算法FPGA开发经验；熟练掌握Verilog；有高速信号调试经验（PCIE/MIPI/LVDS等）；大规模电路逻辑设计与复杂时序解决能力
简历满足情况 high dimensions.tech_power.resume_fulfillment
95 公式 59
公式计算
95*50%/0.8 = 59分
具备5年FPGA开发经验，熟练掌握Verilog，拥有丰富的PCIE、100GE、Aurora等高速接口调试经验及大规模逻辑设计能力。虽无直接的图像处理算法FPGA经验，但底层高速信号处理与复杂系统开发能力完全可迁移，技术实力充分满足岗位要求。
JD 要求 dimensions.stability.jd_requirement
稳定性
岗位未明确稳定性要求，默认评估历史任职时长与连贯性
简历满足情况 medium dimensions.stability.resume_fulfillment
40 公式 10
公式计算
40*20%/0.8 = 10分
候选人共有3段正式工作经历，历史平均任职约2.5年。但最近一段工作（精智达半导体）任职仅约6个月，触发稳定性扣分规则，存在一定波动风险。
JD 要求 dimensions.salary_match.jd_requirement
薪资匹配
岗位预算22-30K
简历满足情况 high dimensions.salary_match.resume_fulfillment
95 公式 6
公式计算
95*5%/0.8 = 6分
候选人期望薪资为28-30K，完全落在岗位预算范围内，薪资匹配度极高，无薪资谈判风险。
JD 要求 dimensions.pace_match.jd_requirement
节奏匹配
深圳办公；大小周(早9晚9)；能接受研发攻关期加班和一定的工作压力
简历满足情况 low dimensions.pace_match.resume_fulfillment
信息不足 （60）
候选人意向城市为深圳，地点匹配。但未明确说明是否接受大小周、早9晚9及加班节奏，也未提供预计到岗时间，关键接受意愿缺失，不纳入综合分计算。
JD 要求 dimensions.communication.jd_requirement
简历呈现
此项为简历信息表达质量评估，JD无直接要求
简历满足情况 high dimensions.communication.resume_fulfillment
85 公式 5
公式计算
85*5%/0.8 = 5分
简历模块清晰，阅读顺序合理；任职时间、职位、项目字段完整；项目描述能清晰说明背景、个人动作和结果，技术细节详实，无明显矛盾，呈现质量优秀。
处理概览
当前状态 初筛完成
投递时间 08-05 11:30:21
初筛时间 08-05 03:32
AI 模型 qwen3.7-plus
查看原始日志
简历获取
ID: 581
简历解析
ID: 628
简历初筛
ID: 607
JD 分析 jd_analysis
维度评分 dimensions
硬性要求 dimensions.tech_power.raw_score
95
公式 59
公式计算
95*50%/0.8 = 59分
稳定性 dimensions.stability.raw_score
40
公式 10
公式计算
40*20%/0.8 = 10分
薪资匹配 dimensions.salary_match.raw_score
95
公式 6
公式计算
95*5%/0.8 = 6分
节奏匹配 dimensions.pace_match.raw_score
信息不足
简历呈现 dimensions.communication.raw_score
85
公式 5
公式计算
85*5%/0.8 = 5分
硬性要求 high dimensions.tech_power.resume_fulfillment
95 公式 59
公式计算
95*50%/0.8 = 59分

具备5年FPGA开发经验，熟练掌握Verilog，拥有丰富的PCIE、100GE、Aurora等高速接口调试经验及大规模逻辑设计能力。虽无直接的图像处理算法FPGA经验，但底层高速信号处理与复杂系统开发能力完全可迁移，技术实力充分满足岗位要求。

稳定性 medium dimensions.stability.resume_fulfillment
40 公式 10
公式计算
40*20%/0.8 = 10分

候选人共有3段正式工作经历，历史平均任职约2.5年。但最近一段工作（精智达半导体）任职仅约6个月，触发稳定性扣分规则，存在一定波动风险。

薪资匹配 high dimensions.salary_match.resume_fulfillment
95 公式 6
公式计算
95*5%/0.8 = 6分

候选人期望薪资为28-30K，完全落在岗位预算范围内，薪资匹配度极高，无薪资谈判风险。

节奏匹配 low dimensions.pace_match.resume_fulfillment
信息不足 （60）

候选人意向城市为深圳，地点匹配。但未明确说明是否接受大小周、早9晚9及加班节奏，也未提供预计到岗时间，关键接受意愿缺失，不纳入综合分计算。

简历呈现 high dimensions.communication.resume_fulfillment
85 公式 5
公式计算
85*5%/0.8 = 5分

简历模块清晰，阅读顺序合理；任职时间、职位、项目字段完整；项目描述能清晰说明背景、个人动作和结果，技术细节详实，无明显矛盾，呈现质量优秀。

综合评分 81 match_score
公式得分 81
公式计算
95*50%/0.8 + 40*20%/0.8 + 95*5%/0.8 + 85*5%/0.8 = 81分
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