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申

申合国resume_parse_logs.name

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13662231845resume_parse_logs.phone 本科 · 南华大学resume_fetch_logs.raw_data.data._widget_1704704608270 / resume_fetch_logs.raw_data.data._widget_1704704608271
FPGA工程师-深圳 resume_fetch_logs.raw_data.data._widget_1704718033203 下载简历
综合评分 89 match_score
公式得分 91
公式计算
95*50%/0.8 + 80*20%/0.8 + 90*5%/0.8 + 90*5%/0.8 = 91分
推荐结论：强烈推荐 recommendation
关键优势 summary.key_strengths
  • 核心技能完全覆盖，具备4.5年图像处理ISP算法及FPGA pipeline开发经验，远超JD要求的3年
  • 技术栈丰富且深厚，熟练掌握Verilog、高速接口（MIPI/PCIE等）及多种FPGA平台，具备复杂系统架构规划能力
  • 职业稳定性极佳，最近一段工作经历超4年且职责持续扩大，整体工作年限达16年
主要顾虑 summary.key_concerns
  • 岗位明确要求大小周（早9晚9），候选人未明确表态是否接受该工作节奏
  • 候选人期望薪资下限（30K）触及岗位预算上限，需确认最终薪资结构及可协商空间
推荐总结 summary.recommendation_summary
候选人技术实力强劲且经验高度匹配，稳定性优秀，薪资期望在预算边缘但可沟通。虽节奏匹配信息缺失，但不影响其作为高优技术人才的推荐，建议推进面试并重点沟通工作节奏与薪资细节。
JD 要求 dimensions.tech_power.jd_requirement
硬性要求
统招本科以上，3年以上图像处理/信号处理算法FPGA开发经验；熟练Verilog；熟悉MIPI/PCIE/LVDS等高速接口；具备大规模电路逻辑设计和调试经验；英语阅读能力。
简历满足情况 high dimensions.tech_power.resume_fulfillment
95 公式 59
公式计算
95*50%/0.8 = 59分
完全满足。拥有16年研发经验，其中近4.5年专注于医疗IVD设备的图像处理ISP算法及FPGA pipeline开发。熟练掌握Verilog及各类高速接口，具备Zynq/Altera等多平台开发经验，英语CET6。
JD 要求 dimensions.stability.jd_requirement
稳定性
JD未明确稳定性要求，按通用标准评估：最近一段工作任职时长及历史任职稳定性。
简历满足情况 medium dimensions.stability.resume_fulfillment
80 公式 20
公式计算
80*20%/0.8 = 20分
稳定性极佳。最近一段工作任职超4年，且历史5段工作经历均保持较长任期（2.7年至4.5年不等），无频繁跳槽记录，当前仍在职。
JD 要求 dimensions.salary_match.jd_requirement
薪资匹配
岗位薪资预算为 22-30K。
简历满足情况 high dimensions.salary_match.resume_fulfillment
90 公式 6
公式计算
90*5%/0.8 = 6分
候选人期望薪资为 30-35K。最低期望30K位于岗位预算上限，匹配度较高，但需确认其薪资底线及岗位定级。
JD 要求 dimensions.pace_match.jd_requirement
节奏匹配
工作地点：深圳；工作节奏：大小周(早9晚9)，需接受研发攻关期加班和一定工作压力。
简历满足情况 low dimensions.pace_match.resume_fulfillment
信息不足 （60）
期望城市匹配。但候选人未明确说明是否接受大小周及早9晚9的工作节奏，关键接受意愿缺失，无法可靠判断节奏匹配度。
JD 要求 dimensions.communication.jd_requirement
简历呈现
此项为简历信息表达质量评估，JD无直接要求。
简历满足情况 high dimensions.communication.resume_fulfillment
90 公式 6
公式计算
90*5%/0.8 = 6分
简历呈现质量高。结构清晰，字段完整，技术栈与项目经验描述详实且一致，能清晰展现候选人的技术深度与项目成果。
处理概览
当前状态 初筛完成
投递时间 08-20 11:35:31
初筛时间 08-20 03:37
AI 模型 qwen3.7-plus
查看原始日志
简历获取
ID: 727
简历解析
ID: 792
简历初筛
ID: 768
JD 分析 jd_analysis
维度评分 dimensions
硬性要求 dimensions.tech_power.raw_score
95
公式 59
公式计算
95*50%/0.8 = 59分
稳定性 dimensions.stability.raw_score
80
公式 20
公式计算
80*20%/0.8 = 20分
薪资匹配 dimensions.salary_match.raw_score
90
公式 6
公式计算
90*5%/0.8 = 6分
节奏匹配 dimensions.pace_match.raw_score
信息不足
简历呈现 dimensions.communication.raw_score
90
公式 6
公式计算
90*5%/0.8 = 6分
硬性要求 high dimensions.tech_power.resume_fulfillment
95 公式 59
公式计算
95*50%/0.8 = 59分

完全满足。拥有16年研发经验，其中近4.5年专注于医疗IVD设备的图像处理ISP算法及FPGA pipeline开发。熟练掌握Verilog及各类高速接口，具备Zynq/Altera等多平台开发经验，英语CET6。

稳定性 medium dimensions.stability.resume_fulfillment
80 公式 20
公式计算
80*20%/0.8 = 20分

稳定性极佳。最近一段工作任职超4年，且历史5段工作经历均保持较长任期（2.7年至4.5年不等），无频繁跳槽记录，当前仍在职。

薪资匹配 high dimensions.salary_match.resume_fulfillment
90 公式 6
公式计算
90*5%/0.8 = 6分

候选人期望薪资为 30-35K。最低期望30K位于岗位预算上限，匹配度较高，但需确认其薪资底线及岗位定级。

节奏匹配 low dimensions.pace_match.resume_fulfillment
信息不足 （60）

期望城市匹配。但候选人未明确说明是否接受大小周及早9晚9的工作节奏，关键接受意愿缺失，无法可靠判断节奏匹配度。

简历呈现 high dimensions.communication.resume_fulfillment
90 公式 6
公式计算
90*5%/0.8 = 6分

简历呈现质量高。结构清晰，字段完整，技术栈与项目经验描述详实且一致，能清晰展现候选人的技术深度与项目成果。

综合评分 89 match_score
公式得分 91
公式计算
95*50%/0.8 + 80*20%/0.8 + 90*5%/0.8 + 90*5%/0.8 = 91分
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