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唐嘉鑫resume_parse_logs.name

初筛完成 1-6a9e69b8-1534d7-ef82cbf45b8d
15060977396resume_parse_logs.phone 本科 · 北京邮电大学resume_fetch_logs.raw_data.data._widget_1704704608270 / resume_fetch_logs.raw_data.data._widget_1704704608271
FPGA工程师-深圳 resume_fetch_logs.raw_data.data._widget_1704718033203 下载简历
综合评分 81 match_score
公式得分 82
公式计算
90*50%/0.95 + 80*20%/0.95 + 60*20%/0.95 + 95*5%/0.95 = 82分
推荐结论:强烈推荐 recommendation
关键优势 summary.key_strengths
  • 精通Verilog及大规模逻辑设计,具备复杂时序收敛与板级调试能力
  • 拥有40G/100G高速接口及报文处理量产项目经验,交付能力强
  • 211科班出身,具备完整的项目周期主导与多版本迭代经验
主要顾虑 summary.key_concerns
  • 缺乏图像处理/视觉算法FPGA开发经验,需评估场景迁移能力
  • 未明确表态是否接受大小周及早9晚9的工作节奏
  • 期望薪资面议,需后续沟通确认具体数字
推荐总结 summary.recommendation_summary
候选人底层FPGA技术能力突出,有高速信号量产经验,技术匹配度极高。虽缺乏图像视觉场景经验且未明确加班意愿,但综合技术实力强,建议推进面试以核实场景迁移能力及工作节奏接受度。
JD 要求 dimensions.tech_power.jd_requirement
硬性要求
3年以上图像处理/信号处理算法FPGA开发经验,熟练Verilog,熟悉MIPI/PCIE/USB/LVDS等高速接口,具备大规模逻辑设计与时序调试能力。
简历满足情况 high dimensions.tech_power.resume_fulfillment
90 公式 47
公式计算
90*50%/0.95 = 47分
熟练掌握Verilog及大规模逻辑设计,具备40G/100G高速接口(Interlaken/DDR/Aurora)调试与量产经验。但过往经验集中在网络DPI报文处理,缺乏MIPI/USB/LVDS及图像/视觉算法场景经验。
JD 要求 dimensions.stability.jd_requirement
稳定性
JD未明确说明,依据历史任职年限与稳定性规则评估。
简历满足情况 medium dimensions.stability.resume_fulfillment
80 公式 17
公式计算
80*20%/0.95 = 17分
毕业后仅有一段正式工作经历(2023.03至今),任职超3年,期间担任FPGA模块负责人,职责持续扩大,稳定性良好。
JD 要求 dimensions.salary_match.jd_requirement
薪资匹配
22-30K
简历满足情况 low dimensions.salary_match.resume_fulfillment
信息不足 (50)
目前薪资20K,期望薪资面议,缺乏明确期望数字,无法直接评估匹配度。
JD 要求 dimensions.pace_match.jd_requirement
节奏匹配
深圳工作,大小周(早9晚9),需接受研发攻关期加班和压力。
简历满足情况 medium dimensions.pace_match.resume_fulfillment
60 公式 13
公式计算
60*20%/0.95 = 13分
明确接受深圳工作,但未说明是否接受大小周及早9晚9的高强度工作节奏,到岗时间未知。
JD 要求 dimensions.communication.jd_requirement
简历呈现
此项为简历信息表达质量评估,JD无直接要求。
简历满足情况 high dimensions.communication.resume_fulfillment
95 公式 5
公式计算
95*5%/0.95 = 5分
简历结构清晰,模块完整,项目经历采用STAR法则描述,有明确的量化成果和技术细节,表达专业度高。

版本对比

共 2 个版本
版本 解析时间 城市/薪资 综合评分 推荐结论 初筛状态
v2 当前
09-07 15:37 81 强烈推荐 成功
v1
09-07 15:35 79 通过 成功
处理概览
当前状态 初筛完成
投递时间 09-07 15:37:30
初筛时间 09-07 07:40
AI 模型 qwen3.7-plus
JD 分析 jd_analysis
维度评分 dimensions
硬性要求 dimensions.tech_power.raw_score
90
公式 47
公式计算
90*50%/0.95 = 47分
稳定性 dimensions.stability.raw_score
80
公式 17
公式计算
80*20%/0.95 = 17分
薪资匹配 dimensions.salary_match.raw_score
信息不足
节奏匹配 dimensions.pace_match.raw_score
60
公式 13
公式计算
60*20%/0.95 = 13分
简历呈现 dimensions.communication.raw_score
95
公式 5
公式计算
95*5%/0.95 = 5分
硬性要求 high dimensions.tech_power.resume_fulfillment
90 公式 47
公式计算
90*50%/0.95 = 47分

熟练掌握Verilog及大规模逻辑设计,具备40G/100G高速接口(Interlaken/DDR/Aurora)调试与量产经验。但过往经验集中在网络DPI报文处理,缺乏MIPI/USB/LVDS及图像/视觉算法场景经验。

稳定性 medium dimensions.stability.resume_fulfillment
80 公式 17
公式计算
80*20%/0.95 = 17分

毕业后仅有一段正式工作经历(2023.03至今),任职超3年,期间担任FPGA模块负责人,职责持续扩大,稳定性良好。

薪资匹配 low dimensions.salary_match.resume_fulfillment
信息不足 (50)

目前薪资20K,期望薪资面议,缺乏明确期望数字,无法直接评估匹配度。

节奏匹配 medium dimensions.pace_match.resume_fulfillment
60 公式 13
公式计算
60*20%/0.95 = 13分

明确接受深圳工作,但未说明是否接受大小周及早9晚9的高强度工作节奏,到岗时间未知。

简历呈现 high dimensions.communication.resume_fulfillment
95 公式 5
公式计算
95*5%/0.95 = 5分

简历结构清晰,模块完整,项目经历采用STAR法则描述,有明确的量化成果和技术细节,表达专业度高。

综合评分 81 match_score
公式得分 82
公式计算
90*50%/0.95 + 80*20%/0.95 + 60*20%/0.95 + 95*5%/0.95 = 82分
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